如何最大限度减少线缆设计中的串扰

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大明湖畔的猫 — Tue, 22 Apr 2014 11:54:05 GMT

减少串扰：1,增加信号路径之间的间距，一般间距为线宽的3倍以上，串扰可以减少70%以上使耦合长度尽量短，越长影响越大2,减小信号路径的特性阻抗3,使用介电常数较低的叠层。暂时了解的就这么多设计线缆、电线以及 PCB 路由设计方案时要注意杂散电容耦合的影响。4,在需要较长线缆的应用中，应选择电容较低的线缆，并通常需要在两个可能相互耦合的信号间加入一个或多个 ac GND 信号

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mmuuss586 — Wed, 09 Apr 2014 01:54:52 GMT

电缆是比较重要。除了你上面说的，个人补充下，如有错误请指正：

1、接插件的选取，线和PCB设计再好，接插件不好，会从接插件接点处引入干扰；

2、尽量缩短电缆的长度；

3、最好加屏蔽；

4、电缆接头的制作，最好使用专用的工具，接头处容易引入干扰；

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Yujing Wu — Tue, 11 Mar 2014 05:51:48 GMT

导线引起的通讯不畅也遇到过，特别是距离交流电比较近时，外露的线束尽量用金属编制网加屏蔽，最好用屏蔽线。现在做设计时需要外引的数字信号基本都是用差分线，如RS485或以太网，抗干扰能力还是还是很强的；模拟信号如作者所说，基本都是一根信号加一根地线。

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yuanhang niu — Fri, 21 Feb 2014 10:10:04 GMT

解决串扰的最好办法就是设法屏蔽它，因为参考点怎么选，最后还是会有电容存在的，尽可能减小的话就只有增大间距使耦合长度尽量短，严格遵守PCB的布局布线规约呗，什么3W法则之类的，在安全可靠的基础上最大限度的减少线间距，总之鱼和熊掌不可兼得不过这样一来，所以应该权衡利弊吧。

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rujun yang — Sat, 15 Feb 2014 10:06:03 GMT

一般低频设计中不太考虑串扰的问题，在进行高频设计时就要格外的用心了，没别的办法，严格遵守PCB的布局布线规约呗，什么3W法则之类的，在安全可靠的基础上最大限度的减少线间距，总之鱼和熊掌不可兼得，有时候如果空间足够，成本要求不高的时候可以适当加入一些共模电感之类的

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zhangbo li — Mon, 10 Feb 2014 07:40:34 GMT

信号线间的相互干扰主要会引起信号延迟、噪声耦合或瞬态电压，其表现形式就是以电容的形式引起信号线中高低电平的变化，从而造成通讯的准确性降低；在信号线之间增加地线的办法是非常好的，这就是说让信号线都同时对地产生一个对地电容的，但是相对之间该电容的影响就可以忽略不计的了。。

像RS485总线通讯就是很好的例子，，该通讯时就是需要做一个信号隔离处理，其机理同上边是一致的

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guojin zhang — Mon, 27 Jan 2014 07:46:37 GMT

解决串扰的最好办法就是屏蔽它，因为参考点怎么选，最后还是会有电容存在的，尽可能减小的话就只有

增大两线的间距，不过这样一来，板子的利用率就会降下来，所以应该权衡利弊吧。此贴是在联系实际工程背景下

写出的，对我们很有指导意义。

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weicheng li — Sat, 25 Jan 2014 09:21:11 GMT

在设计线缆、电线以及 PCB 路由设计方案时要注意杂散电容耦合的影响。在需要较长线缆的应用中，应选择电容较低的线缆，并通常需要在两个可能相互耦合的信号间加入一个或多个 ac GND 信号。

有些疑问？电容较低的电缆该如何确定，如何定义，如何选择，还有这种电缆是通直流还是交流的？寄生的电容是要滤什么波的，是差模还是共模那？

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jinrui liu — Sat, 25 Jan 2014 01:48:31 GMT

EMI个非常令人头疼，却又是每个工程师是不得不面对的问题，在这方面，理论性的系统性的只是尚不够完善，很多问题都是依靠工程师已有的技术经验解决，或者直接采用屏蔽等非常手段，建议同时也希望德州仪器能在这方面做出傲人的成绩，静候佳音！

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xiang zhao1 — Sat, 25 Jan 2014 01:18:42 GMT

这种方式和多层pcb设计同理，用电源或地层达到屏蔽作用，但是线缆还可以考虑自身的屏蔽能力，如使用带有屏蔽设计的线缆等。图中的GND电缆不知道是什么意思，同样的电缆接地？如果是这样，为什么不换用屏蔽电缆呢？

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wenya wu — Sat, 25 Jan 2014 00:45:18 GMT

以往的经验，减少串扰有几种办法：1，增加信号路径之间的间距，一般间距为线宽的3倍以上，串扰可以减少70%以上；2，使耦合长度尽量短，越长影响越大；3，减小信号路径的特性阻抗；4，使用介电常数较低的叠层。暂时了解的就这么多，本帖对串扰进行如此紧密的试验而得出的结论是我们值得学习和借鉴的