<?xml-stylesheet type="text/xsl" href="https://e2echina.ti.com/cfs-file/__key/system/syndication/rss.xsl" media="screen"?><rss version="2.0" xmlns:dc="http://purl.org/dc/elements/1.1/" xmlns:slash="http://purl.org/rss/1.0/modules/slash/" xmlns:wfw="http://wellformedweb.org/CommentAPI/"><channel><title>如何使用TI电源时序控制器在5G MIMO的应用</title><link>/blogs_/b/power_house/posts/ti-5g-mimo</link><description>5G是目前通信设备领域的市场趋势， Massive MIMO指的是64T64R应用中常用的多输入和多输出, 更多的发送器和接收器通道需要更多的数字处理器（FPGA / ASIC）来执行数据传输，而典型的64T64R MIMO应用中通常需要4-5个数字处理器。 每个FPGA都需要自己的电源上电/下电的时序，以便FPGA能够正常工作。 在下面的图1中，是典型的64T64R Massive MIMO框图，4颗 ASIC / FPGA用于与4颗 RF采样模拟前端（ AFE7799 ）进行通信和控制。
 图</description><dc:language>zh-CN</dc:language><generator>Telligent Community 13</generator></channel></rss>