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紧急求助:LMK03806B时而能够正常输出,时而无法正常输出?LMK03806芯片通过Xilinx K7 FPGA配置,电路参考手册,只是输入部分没有一个电容和电阻,而是直接接了0.1uF电容到单端输入Oscin,输入为62MHz,而输出为5路765.472MHz。目前测试有时输出的65.472MHz能够正常输出,有时输出什么都没有,然后那个某一个默认输出一路有62MHz的信号,感觉像是芯片处于默认状态了?求助各位是否有人遇到过这种情况?

Other Parts Discussed in Thread: LMK03806, CODELOADER

紧急求助:LMK03806B时而能够正常输出,时而无法正常输出?

LMK03806芯片通过Xilinx K7 FPGA配置,电路参考手册,只是输入部分没有一个电容和电阻,而是直接接了0.1uF电容到单端输入Oscin。

输入端0.1uf电容后输入的62MHz信号幅度大约为400mVpp,符合手册0.2Vpp~2.4Vpp输入要求。

输出为5路765.472MHz。一路配置为Lvcmos,另外四路配置为lvds。目前测试有时输出的65.472MHz能够正常输出,有时输出什么都没有,然后那个某一个默认输出一路有62MHz的信号,感觉像是芯片处于默认状态了?求助各位是否有人遇到过这种情况?

有些具体的问题,请问下各位高手!

1  2018版本手册中P22页,有如下图提示:It is required to program R3 after power up. 请问到底是怎么理解这句话?怎么样的编程顺序呢?没理解

是A顺序: R0(只是复位的那一位置位为1)->    R0(正常配置)-> R1 ->R2->R3->R4 .........

还是B顺序:R0(只是复位的那一位置位为1)-> R3 ->  R0(正常配置)     -> R1->   R2->R3->R4 .........

还是C顺序:R0(只是复位的那一位置位为1)-> R3 ->  R0(正常配置)   -> R1  ->   R2 ->R4 .........

2 关于SYNC疑问。这个sync到底作用或意义是什么呢?看手册没看太明白。我硬件上FPGA的一个管脚接了这个sync引脚,现在配置代码里最后的把sync有个从高拉倒低的操作。各位一般如何使用这个sync信号呢?对应寄存器应该如何配置呢?如下这位需要配置成1还是0呢

3 关于环路滤波器疑问。手册中P36页,说可以通过配置内部阻容就可以完成3阶或4阶环路滤波器,无需外部器件。我想问下那么电路中的cpout管脚外部的换滤波器是否均可以什么都不接了呢?完全空着。

感觉手册中的阻容只够配成2阶的滤波器,根本不够配成三阶或四阶呢?我的疑问是,如果时而锁定时而无法锁定有没有可能是我外部环路滤波器阻容选的有问题?

那么是不是我外部阻容全部去掉,只是选用内部的阻容就可以完成环路滤波功能了呢?这样信号就能够很快锁定了?

4 请问除了手册以及那个codeloader等工具外,哪里有配置的寄存器参考值或者参考历程代码?多谢

谢谢各位,有用过的希望能够帮帮忙,您的指点将会照亮我们前进的路,谢谢

  • The registers are to be programmed in numeric order with R0 being the first and R31 being the last register
    programmed as shown below:
    1. Program R0 with RESET bit = 1. This ensures that the device is configured with default settings. When
    RESET = 1, all other R0 bits are ignored.
    – If R0 is programmed again during the initial configuration of the device, the RESET bit must be cleared.
    2. R0 through R5: CLKouts.
    – It is required to program R3 after power up.
    – Program as necessary to configure the clock outputs, CLKout0 to CLKout11 as desired. These registers
    configure clock output controls such as powerdown, divider value, and clock source select.
    3. R6 through R8: CLKouts.
    – Program as necessary to configure the clock outputs, CLKout0 to CLKout11 as desired. These registers
    configure the output format for each clock output.
    4. R9: Undisclosed bits.
    – Program this register as shown in the register map for proper operation.
    5. R10: OSCouts.
    6. R11: SYNC, and XTAL.
    7. R12: LD pin and SYNC.
    8. R13: Readback pin & GPout0.
    9. R14: GPout1.
    10. R16: Undisclosed bits.
    – Program this register as shown in the register map for proper operation.
    11. R24: Partially integrated PLL filter values.
    12. R26, R28, R29, and R30: PLL.
    13. R31: uWire readback and uWire lock.
  • 1. 先配置R0的reset bit,也就是您说的只是复位的那一位置位为1。
    然后上电起来稳定之后再配置R3,其他的输出配置R0~R5 根据实际需求需要进行都可,顺序没有特殊要求了。
  • 2. sync是保证所有的输出同步引脚,比如所有通道输出使用同一个上升沿。 sync引脚可以和主控比如FGPA的IO连接,在接的时候,建议串联一个小电阻33ohm和一个电容到地组成滤波器,datasheet中Figure25 有给出参考电路。
  • 3. 使用内部环路滤波的话,Cpout引脚可悬空。
    4。 使用codeloader工具,将输入输出频率等参数设置好,便可以参考其寄存器配置情况。 其他工具还有clock design tool,TI CSpro等有关clock器件的配置工具。
  • 谢谢您!谢谢您回答我的问题!到现在 ,关于这款芯片我还是有很多问题!没有研究清楚。
    等这几天再研究下再提问吧!
  • 硬件加电大约500ms后,所有输入时钟全部稳定了,我开始先配置了R0的resetbit 然后没有先配置R3,只是按照正常顺序配置了所有其他的寄存器,一切运行正常。只是输出的65.472MHz的谐波太强了,不知道怎么处理。
  • 您写的就是手册里的,那么按照您写的,下面的配置顺序您觉得是哪一个呢?
    还是B顺序:R0(只是复位的那一位置位为1)-> R3 -> R0(正常配置) -> R1-> R2->R3->R4 .........
    还是C顺序:R0(只是复位的那一位置位为1)-> R3 -> R0(正常配置) -> R1 -> R2 ->R4 .........
    二者区别:后面R3要不要再重新配置一遍?

    还有一个问题:这个R0复位那一个bit位 是系统硬件加电后就一定要把他配置一下然后等输入时钟稳定后再配置其他的寄存器,还是可以像我现在的处理方式一样,等系统加电500ms后统一配置所有寄存器,包括r0这个reset位。