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TMUXHS4212: PCIE GEN5 CLK Design
user4512941
TI 认为已经解决
Part Number: TMUXHS4212 It will be used in
PCIe
5.0 CLOCK design, which can meet
PCIE
5.0 delay time (what's the delay time in the 1:2 or 2:1 design?) and phase jitter needs?
17 天前
接口
接口论坛
TDA4VM-Q1: PCIE是否支持ENDPOINT
liu Landon
TI 认为已经解决
Part Number: TDA4VM-Q1 TDA4Vx的
PCIE
是否支持EP角色?目前手册中只看到支持RC
7 天前
处理器
处理器论坛
RE: DS160PR1601: 是否支持PCIe Gen 1.0和PCIe Gen 2.0
Kailyn Chen
wenmeng 说: 我们使用场景要兼容
PCIe
Gen1.0到
PCIe
Gen 4.0,有没有SI的模型可以提供? 抱歉没有SI model。 wenmeng 说: 调试时需要看眼图,需要用到Sigcon Architect的软件,可否帮忙批一下,好像需要申请,保证能够支持 DS160PR1601 。 您好,需要自行申请,提交到美国那边的哈,并且申请的时候使用英文填写信息。
1 个月前
接口
接口论坛
TMS320C6655: PCIE复位设计
?? ?
Part Number: TMS320C6655 在TMS320C6655的Data Manual中,描述了 RESET、POR、RESETFULL 三个信号在上电&复位时序中的关系,但是并没有提到
PCIE
RESET 与这三个信号之间的关系,以及对应的复位时间spec。 在我们的设计中,TMS320C6655与CPU通过
PCIE
总线连接,目前遇到低概率的
PCIE
识别问题,无法识别到TMS320C6655。现在无法确定是否是复位设计的问题所导致的。 需求:需要明确的
PCIE
RESET硬件设计&软件设计要求…
17 天前
处理器
处理器论坛
RE: DS160PR810EVM-RSC: PCIe的时钟CLK是否要经过Redrive,参考设计并没有这样做
Amy Luo
您好, 这里应该是不需要。
PCIE
redrive 不包含refclk 通道,如果refclk 需要调理的话应该是考虑使用retimer,TI
PCIE
retimer DS160PT801 。 下面视频希望对你有帮助: https://www.ti.com/video/6314066968112?keyMatch=RETIMER%20VS%20REDRIVER#transcript-tab
1 个月前
接口
接口论坛
RE: TDA4VM: PCIE的时钟相关
Gary Lu
您好, ? ? 说: 它的时钟来源有哪些? 外部时钟源和内部PLL(锁相环) ? ? 说: 内部是不是还会对时钟信号做处理?进行了什么样的处理? 可以用于产生
PCIE
模块所需的时钟信号。PLL可以通过调整其内部参数,如分频器和倍频器,来生成符合
PCIE
规范要求的时钟频率。 ? ? 说: 在低功耗状态下会有哪些时钟操作? 在低功耗状态下,处理器通常会采取一些措施以降低功耗。包括降低时钟频率、关闭不必要的模块或降低电压等。时钟频率的调整是通过动态电压和频率调整(DVFS)机制来实现
3 个月前
处理器
处理器论坛
RE: TMS320C6678: C6678里面的PCIe接口问题请教
Gary Lu
RC
3 个月前
处理器
处理器论坛
Answered
DS80PCI800: DS80PCI800 PCIE SPEED 不是GEN3
?? ?
已解决
Part Number: DS80PCI800 1,Channel 问什么会Lost 2,RXDET STATUS:NOT DETECTED
已回答
3 个月前
接口
接口论坛
RE: RE: LMH1208: LMH1208 Host-Side 100-Ω Output Driver?
Kailyn Chen
您好,为了更好的跟进您的问题,我将您的这个新问题拆出来了。 典型的
PCIE
应用中,AC耦合电容集成在了TX
PCIE
slot端了,所以如果
PCIE
TX端已经集成了耦合电容的话,这里就不需要再加了。
1 个月前
接口
接口论坛
TMS320C6678: TMS320C6678 local reset
1 xu
TI 认为已经解决
Part Number: TMS320C6678 Hi: 我们在TMS320C6678上面开发异常保护功能时,有这样一个需要:core0作为主核,实时监控Core1-Core7是否异常,当 Core1-Core7某一个核异常时,Core0对该核执行local reset; 我们在编写local reset功能代码时,参考了
PCIE
local reset 处理流程,但是Core0执行Core1的local reset 后,Core1无法跳转到main函数运行,请问local reset 功能配置还有什么需要特别注意的吗…
13 天前
处理器
处理器论坛
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