C2000™︎ 微控制器（参考译文帖）(Read Only) - 最近的话题

[参考译文] SMJ320F240：请求 SMJ320F240 低级 JTAG 扫描文档以手动下载 RAM/DR 控制和 IR 代码

admin — Fri, 13 Mar 2026 09:08:26 GMT

Other Parts Discussed in Thread: SMJ320F240

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部件号： SMJ320F240

您好：

我正在使用 SMJ320F240/ TMS320F240/ C24x 和我正在查找描述的正确 TI 文档 低级 TI 扫描/仿真协议 通过 JTAG 引脚手动控制器件。

手动驱动 JTAG 引脚 ( TMS、TDI、TDO、TCK、TRST )、
正确移动 指令寄存器 (IR) 和 数据寄存器 (DR) 值、
将代码访问/下载到片上 RAM 、
在 DSP 内核上设置执行入口点或以其他方式开始执行。

我已经知道了 IEEE 1149.1 标准、我找到了 JTAG/MPSD 仿真技术参考 (SPDU079) 、它似乎涵盖了物理接口、标头和仿真设计注意事项。但是、我没有找到完整描述的文档 特定于器件的扫描操作 中的示例 TMS320F240 、例如：

IR 操作码、
DR 格式、
控制 CPU 所需的扫描序列、
RAM 下载过程、
以及在加载代码后释放/启动内核的方法。

我也找到了引用 TMS320F/C24x DSP 控制器参考指南 (SPRU160) 和 TMX320F240 基于 JTAG 的闪存编程器自述文件 、但我仍然无法确定哪个文档包含的是准确的 低级手动 IR /DR 驾驶细节 漏电流。

请告诉我：

哪个确切的 TI 文档、存档或示例包描述了 手动低级扫描控制 指定 TMS320F240 、
这些信息是否公开、
以及是否 TMX320F240 基于 JTAG 的工具 包含此器件唯一可用的 RAM 下载和内核启动示例。

如果可能,我希望确切的 文档编号 、 下载链接 或 归档/包名称 。

非常感谢您的帮助。

此致

[参考译文] TMS320F28335：DSP28335 黑屏问题

admin — Fri, 13 Mar 2026 07:19:31 GMT

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器件型号： TMS320F28335

您好、专家

1.定义
所谓的“白屏“是指操作面板无法正常与 DSP 建立 232 串行通信的情况；这会导致面板反复尝试与 DSP 连接并导致连续重启；同一面板可以与 DSP 正常通信并在普通 DSP 控制板上显示内容、因此问题与面板本身无关；问题指向控制板。

2.白屏外观的过程
关闭电源后、白色屏幕始终出现、然后再次打开；
一种白屏情况:当参数设置在屏幕黑屏之前被保存,而屏幕在电源关闭然后打开后再次黑屏时,有一定的可能性发生这种情况。即使在重复关闭电源然后打开几十次的过程后,屏幕仍然保持在白色屏幕状态;
连接仿真器后、读取外部器件闪存的参数保存区域并将其保留一段时间、即可恢复正常显示；但是、当仿真器断开连接时、白屏会重新出现；
仿真器读取的参数保存区域中的参数被意外擦除。参数擦除可能会导致白屏？
白屏情况：手动关闭器件、同时保存参数、导致 DSP 擦除外设闪存中保存的参数区域；断电后恢复电源时、可能会触发白屏；但与之前的白屏不同；多次断电和通电后可恢复正常通信。

3、面板与 DSP 之间的通信机制
在 DSP 中进行系统初始化并完成所有外设器件的初始化后、配置用于与面板 232 通信的 SCI 串行端口；使用具有固定参数配置的 SCIa 端口。无需获取外部参数、例如配置后从闪存读取参数、即使意外擦除外部闪存参数区域、它也不会影响 SCIa 的通信。

4.问题
1、外部闪存的读写由 XINTF 模块处理。 XINTF 模块是否有任何错误操作？
2. DSP 将在什么情况下进入暂停状态?

[参考译文] TMS320F28P550SJ：SPIPTE 被拉至低电平时的 SPI 通信

admin — Fri, 13 Mar 2026 03:38:17 GMT

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器件型号： TMS320F28P550SJ

您好、champ、

我们的工程师将 SPIPTE 引脚连接至低电平、并使 SPI 模块在 FIFO 模式下运行。在模式 0、2 和 3 下、主从器件之间的通信良好。但是、在模式 1（极性=0、相位=1）下、SPI 从器件将失去同步并接收到不正确的数据位。

在 TRM 中、我们发现 TI 不建议始终将 SPIPTE 引脚拉至低电平。如果是、在编码器应用中使用 CLB 和 SPI 时是否存在潜在问题、例如为 T-format 编码器拉低 SPIPTE？

请告知您的注释、当 SPIPTE 被拉至低电平时、SPI 从器件在模式 1 下失去同步功能、而在其他模式下正常工作的原因是什么？

谢谢。此致、

Luke

[参考译文] F29H85X-SSU-SECCRC SOM 值

admin — Thu, 12 Mar 2026 05:17:30 GMT

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器件型号： F29H85X-EVM-EVM SOM

您好、

其表示为 LINK2 具有在运行时更改保护策略的权限、除非 LINK2 已锁定并提交。在软件开发过程中、LINK2 必须被视为安全代码并对 LINK2 代码进行适当分析和测试、以使代码更好地抵御攻击。

如果我们在运行时更改 SSU 值、SECCRC 值将受到怎样的影响？

此外、 HSM 闪存 NONMAIN 扇区的修整区域中存储了哪些 HSM 资产？

谢谢

Geetha K

[参考译文] TMS320F28375D：Tx 中缺少 CAN 帧

admin — Wed, 11 Mar 2026 09:10:20 GMT

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器件型号： TMS320F28375D

我之前使用了两个邮箱 (17 和 18) 的 CAN Tx 实现。 CAN 总线上约有 18 到 36 个节点、每个节点每秒发送 3 条消息。

遗憾的是、我看到总线上缺少 CAN 帧。有时、其中一个 CAN 节点完全静默超过 30 秒。这不是总线‑关闭的情况—我检查了错误计数器、它们保持为 0。

在我的 Tx 实现中、三条具有不同 ID 的消息在软件队列中被缓冲、然后在检查是否有任何邮箱空闲后移动到 IFCMD 寄存器。

我的调试表明邮箱是空闲的、但通过 IF CMD 寄存器发送后、一些消息仍然不会出现在 CAN 总线上。

您能帮助我了解如何进一步调试吗？

我还进行了一项新的更改、在通过 IFCMD 寄存器发送新消息之前、我特意使现有邮箱无效。这显著提高了性能、现在我只看到很少有丢失的 CAN 帧。

请参阅以下代码：

can_ll_send_message(uint32_t ui32ObjID, tCANMsgObject *pMsgObject)
{
    uint32_t ui32CmdMaskReg;
    uint32_t ui32MaskReg;
    uint32_t ui32ArbReg;
    uint32_t ui32MsgCtrl;
    bool bTransferData;

    bTransferData = 0;

    // Wait for busy bit to clear
    while(HWREGH(CAN_BASE + CAN_O_IF1CMD) & CAN_IF1CMD_BUSY)
    {
    }

    
    // New START 
    // Clear the MsgVal bit in the target mailbox first.
    HWREGH(CAN_BASE + CAN_O_IF1ARB) = 0;
    HWREGH(CAN_BASE + CAN_O_IF1ARB + 2) = 0;
    
    // Send only the arbitration clear command to the mailbox.
    HWREG_BP(CAN_BASE + CAN_O_IF1CMD) = CAN_IF1CMD_DIR | CAN_IF1CMD_ARB | (ui32ObjID & CAN_IF1CMD_MSG_NUM_M);

    // Wait for this clear command to finish.
    while(HWREGH(CAN_BASE + CAN_O_IF1CMD) & CAN_IF1CMD_BUSY)
    {
    }
    // New END

    // This is always a write to the Message object as this call is setting a
    // message object.  This call will also always set all size bits so it sets
    // both data bits.  The call will use the CONTROL register to set control
    // bits so this bit needs to be set as well.
    ui32CmdMaskReg = (CAN_IF1CMD_DIR | CAN_IF1CMD_DATA_A | CAN_IF1CMD_DATA_B |
                      CAN_IF1CMD_CONTROL);

    // Initialize the values to a known state before filling them in based on
    // the type of message object that is being configured.
    ui32ArbReg = 0;
    ui32MsgCtrl = 0;
    ui32MaskReg = 0;

        // Set the TXRQST bit and the reset the rest of the register.
        ui32CmdMaskReg |= CAN_IF1CMD_TXRQST;
        ui32MsgCtrl |= CAN_IF1MCTL_TXRQST | CAN_IF1MCTL_NEWDAT;
        ui32ArbReg = CAN_IF1ARB_DIR;
        bTransferData = 1;


    // Set the Arb bit so that this gets transferred to the Message object.
    ui32CmdMaskReg |= CAN_IF1CMD_ARB;

    // Configure the Arbitration registers.
    // Set the 29 bit version of the Identifier for this message object.
    // Mark the message as valid and set the extended ID bit.
    ui32ArbReg |= (pMsgObject->ui32MsgID & CAN_IF1ARB_ID_M) |
                  CAN_IF1ARB_MSGVAL | CAN_IF1ARB_XTD;

    // Set the data length since this is set for all transfers.  This is also a
    // single transfer and not a FIFO transfer so set EOB bit.
    ui32MsgCtrl |= (pMsgObject->ui32MsgLen & CAN_IF1MCTL_DLC_M);

    // Mark this as the last entry if this is not the last entry in a FIFO.
    if((pMsgObject->ui32Flags & CAN_MSG_OBJ_FIFO) == 0)
    {
        ui32MsgCtrl |= CAN_IF1MCTL_EOB;
    }


    // Write the data out to the CAN Data registers if needed.
    if(bTransferData)
    {
        CANDataRegWrite(pMsgObject->pucMsgData,
                        (uint32_t *)(CAN_BASE + CAN_O_IF1DATA),
                        pMsgObject->ui32MsgLen);
    }

    // Write out the registers to program the message object.

    HWREGH(CAN_BASE + CAN_O_IF1MSK) = ui32MaskReg & CAN_REG_WORD_MASK;
    HWREGH(CAN_BASE + CAN_O_IF1MSK + 2) = ui32MaskReg >> 16;

    HWREGH(CAN_BASE + CAN_O_IF1ARB) = ui32ArbReg & CAN_REG_WORD_MASK;
    HWREGH(CAN_BASE + CAN_O_IF1ARB + 2) = ui32ArbReg >> 16;

    HWREGH(CAN_BASE + CAN_O_IF1MCTL) = ui32MsgCtrl & CAN_REG_WORD_MASK;

    // Transfer the message object to the message object specific by ui32ObjID.
    HWREG_BP(CAN_BASE + CAN_O_IF1CMD) = ui32CmdMaskReg | (ui32ObjID & CAN_IF1CMD_MSG_NUM_M);


    // Wait for busy bit to clear
    while(HWREGH(CAN_BASE + CAN_O_IF1CMD) & CAN_IF1CMD_BUSY)
    {
    }

    return;
}

如果您能帮助解释可能发生的情况、那将会很好。
注意：由于我的应用程序限制、我不想使用 Tx 中断。

谢谢、
Reeno Joseph

[参考译文] TMS320F28388D：SPI — 软复位 SPISWRESET 及其对 FIFO 寄存器 (Rx 和 Tx) 的影响

admin — Wed, 11 Mar 2026 07:47:07 GMT

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器件型号： TMS320F28388D

如上图所示、当 SWRESET 设置为 0 时、有各种位会复位。当这个特定位复位时、不会提供有关 FIFO 寄存器状态的显式信息。您能否解释一下在 SWRESET 期间 FIFO 的状态是什么？
此外：

如上所示、我们这里有另一个重置位、似乎适用于 FIFO 操作、同样、对于 Tx 和 Rx、我们再次重置位：当我们已经有 SPIRST 时、您能解释明确的 TX 和 RX FIFO 重置的目的吗？

[参考译文] F29P329SM-Q1：F29P329SM-Q1 和 F29H859TU-Q1 MCU 的预期部署日期

admin — Tue, 10 Mar 2026 13:52:24 GMT

Other Parts Discussed in Thread: F29P329SM-Q1, F29H859TU-Q1

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器件型号： F29P329SM-Q1
主题中讨论的其他器件： F29H859TU-Q1

大家好！

我的团队和我目前正在为汽车级控制单元寻找合适的微控制器。我们考虑了多种选项、例如 TMS570 系列、AM26x 系列和 TMS320F28P659DK。不幸的是、它们都没有满足某些项目要求。到目前为止、我们并未考虑 F29P329SM-Q1 和 F29H859TU-Q1、因为它们具有“预发布“状态、但在查看规格后、我们会变得非常感兴趣。唯一让我们无法选择这类微控制器的一点是、它们仍然是原型/实验器件。是否有任何迹象表明这些器件何时将收到“正在供货“状态以及何时可从电子分销商处购买？

提前感谢、

Jeffrey

[参考译文] TMS320F28379D：应用程序支持

admin — Tue, 10 Mar 2026 12:15:28 GMT

Other Parts Discussed in Thread: TMS320F28379D

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部件号： TMS320F28379D

主席先生/女士、

我们使用 TI TMS320F28379D 来实现多级转换器。是否可以提供 TI 应用工程师的联系人编号/电子邮件 ID、以便更快地为我们的疑问提供支持？

谢谢。此致、

Prashant Gugle

[参考译文] TMS320F28388D：F28388D 以太网帧在 Wireshark 中不可见（CM 示例）、仅显示 PC DHCP

admin — Tue, 10 Mar 2026 12:03:15 GMT

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器件型号： TMS320F28388D

尊敬的 TI 团队：
我尝试使用 Wireshark 从 controlCARD (J4 RJ45) 上的 F28388D 上嗅探以太网帧、但我只能看到由 PC 发起的 DHCP/LLDP 流量。不会出现来自 MCU 的帧。
硬件

集线站上的 F28388D controlCARD
PC 直接连接到 J4 (RJ45)
PHY：DP83822（controlCARD 默认设置）

软件设置

CPU1 工程： Ethernet_c28x_config
CM 工程： ethernet_ex2_phy_loopback
我先运行 CPU1、然后运行 CM

我已经尝试过的

在以太网_c28x_config 示例中使用 CPU1 切换 LED、以检测配置仍然存在并继续记录
CM 中的连续 TX 环路（周期性 Ethernet_sendPacket）和接收断点持续达到正常
有效载荷中的广播目标 MAC
Wireshark 仍然仅显示来自 PC 的 DHCP 发现、无 MCU 帧

问题

如何截取 wiredhak 中的数据包。

[参考译文] TMS320F28379D：帮助解决 F28379D 中的中断嵌套

admin — Tue, 10 Mar 2026 10:49:41 GMT

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部件号： TMS320F28379D

您好、

我有一个使用新函数方法头文件的工作闭环矢量控制代码。我正在使用 EPWM1 INT 来计算控制代码、并使用 EPWM6 INT 来更新设置。

我想实现中断嵌套、在这种情况下 EPWM1 INT 可能被称为 Whille EPWM6 INT 正在进行中。

我正在查看样本扩展、其中主要使用基于寄存器的方法、但我在访问 PieCtrlRegs 时遇到了困难。我收到 PieCtrlRegs 未按预期定义的错误。我找不到没有任何头文件就可以直接使用的地址、添加基于寄存器的头文件会导致很多错误。

实现此目的的最佳方法是什么？（希望解决与未定义 PieCtrlRegs 相关的错误）

示例代码：（欢迎任何建议或潜在问题）

__ interrupt void epwm6ISR (void)
｛
  //添加了用于中断嵌套的额外代码
  Uint16_t TempPIEIER；
  TempPIEIER=PieCtrlRegs.PIEIER3.all； //error
  IER |= 0x003； //通过调整 IER 设置全局优先级
  IER 且= 0x003；
  PieCtrlRegs.PIEIER3.all &= 0x0001；  //error//通过调整 PIEIER3 来设置组优先级以允许 INT3.1 中断当前 ISR
  PieCtrlRegs.PIEACK.ALL = 0xFFFF；   //error//启用 PIE 中断
  asm（“   NOP“）；           //等待一个周期
  EINT；

//添加了用于中断嵌套的额外代码

GPIO_writePin (22、1)； // GPIO 引脚用于检查代码计算时间

//更新设置和参数||||稍后移至较慢的函数
update_allsettings()；//更新过滤器设置

   //
  //清除该计时器的 INT 标志
  //
  EPWM_clearEventTriggerInterruptFlag (EPWM6_BASE)；

  //
  //确认中断组
  //
  INTERRUPT_CLEARACKGROUP (INTERRUPT_ACK_GROUP3)；

//device_delay_US (5)；

GPIO_writePin (22、0)； // GPIO 引脚用于检查代码计算时间

//GPIO_togglePin (24)；//GPIO 24 引脚 34
//GPIO_togglePin (16)；//GPIO 16 引脚 33

//添加了用于中断嵌套的额外代码

  //添加了用于中断嵌套的额外代码
  DINT；
  PieCtrlRegs.PIEIER2.all = TempPIEIER；//error
  添加了用于中断嵌套的额外代码

}

[参考译文] LAUNCHXL-F29H85X：在 Launchpad 原理图中、MCANE 引脚错误地显示为 MCANC 引脚

admin — Tue, 10 Mar 2026 07:13:30 GMT

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器件型号： LAUNCHXL-F29H85X

在 F29x Launchpad 原理图中、MCANC TX 和 RX 引脚分别显示了 GPIO 值 GPIO76 和 GPIO77：

但是、在 F29x SDK 存在的 pin_map.h 文件中、其中显示了与外设对应的 GPIO 引脚、GPIO76 和 GPIO77 没有将 MCANC 外设复用为它们、而是将 MCANE 多路复用为它们、如下所示：

MCANCTX 和 MCANCRX 对应于 GPIO74 和 GPIO75：

现在、我的问题是：
GPIO76 和 GPIO77 正确、必须将标签更改为 Launchpad 原理图上的 MCANETX 和 MCANERX。
或
MCANC 标签正确、GPIO 必须更正为 GPIO74 和 GPIO75？

期待您听到关于这一差异的消息、
此致、
Sumukh.

[参考译文] TMS320F28P650DK：为什么将这些位从 C2000 Ware 5_04_00_00 去掉到 C2000 Ware 6_00_00？

admin — Tue, 10 Mar 2026 03:44:52 GMT

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/1624367/tms320f28p650dk-why-are-these-bits-taken-away-from-c2000-ware-5_04_00_00-to-c2000-ware-6_00_00_00

器件型号： TMS320F28P650DK

尊敬的 champs：

我向我们的客户询问这个问题。

从 C2000 Ware 5_04_00_00 到 C2000 Ware 6_00_00、

为什么是位 是否删除了寄存器 UARTICR 的 EOTIC？

2.为什么删除寄存器 UARTPP 的位 MSE/MS？

[参考译文] TMS320F28P650DK：Driverlib 存储器初始化值似乎不匹配

admin — Tue, 10 Mar 2026 02:48:06 GMT

Other Parts Discussed in Thread: C2000WARE

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

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器件型号： TMS320F28P650DK
主题： C2000WARE 中讨论的其他器件

尊敬的 champs：

我向我们的客户询问这个问题。

在 C：\ti\c2000\C2000Ware_6_00_01_00\driverlib\f28p65x\driverlib 中

memcfg.h

memcfg.c

MEMCFG_sect_LSX_ALL、MEMCG_sect_GSx_ALL、MEMCG_sect_MSGx_ALL 似乎与寄存器不匹配。

以 MEMCFG_sect_LSX_ALL 为例、定义 0x010003FFU 如下所示。

来自表 3-520。 TRM 的 LSxINITDONE 寄存器字段说明

www.ti.com/.../spruiz1

位 10-31 被保留、因此要求：

为什么 0x01003FFU 中有 1？
这是否有目的？
它是由 TI 保留的、还是代码中的一个拼写错误？

//
// LSxRAM - Local shared RAM config
//
#define MEMCFG_SECT_LS0             0x01000001U //!< LS0 RAM
#define MEMCFG_SECT_LS1             0x01000002U //!< LS1 RAM
#define MEMCFG_SECT_LS2             0x01000004U //!< LS2 RAM
#define MEMCFG_SECT_LS3             0x01000008U //!< LS3 RAM
#define MEMCFG_SECT_LS4             0x01000010U //!< LS4 RAM
#define MEMCFG_SECT_LS5             0x01000020U //!< LS5 RAM
#define MEMCFG_SECT_LS6             0x01000040U //!< LS6 RAM
#define MEMCFG_SECT_LS7             0x01000080U //!< LS7 RAM
#define MEMCFG_SECT_LS8             0x01000100U //!< LS8 RAM
#define MEMCFG_SECT_LS9             0x01000200U //!< LS9 RAM
#define MEMCFG_SECT_LSX_ALL         0x010003FFU //!< All LS RAM

/*****************************************************************************
//
// MemCfg_initSections
//
//*****************************************************************************
void
MemCfg_initSections(uint32_t ramSections)
{
    //
    // Check the arguments.
    //
    ASSERT(((ramSections & MEMCFG_SECT_TYPE_MASK) == MEMCFG_SECT_TYPE_D)   ||
           ((ramSections & MEMCFG_SECT_TYPE_MASK) == MEMCFG_SECT_TYPE_LS)  ||
           ((ramSections & MEMCFG_SECT_TYPE_MASK) == MEMCFG_SECT_TYPE_GS)  ||
           ((ramSections & MEMCFG_SECT_TYPE_MASK) == MEMCFG_SECT_TYPE_MSG) ||
           (ramSections == MEMCFG_SECT_ALL));

    //
    // Set the bit in the various initialization registers that starts
    // initialization.
    //
    EALLOW;

    switch(ramSections & MEMCFG_SECT_TYPE_MASK)
    {
        case MEMCFG_SECT_TYPE_D:
            HWREG(MEMCFG_BASE + MEMCFG_O_DXINIT)   |= MEMCFG_SECT_NUM_MASK &
                                                      ramSections;
            break;

        case MEMCFG_SECT_TYPE_LS:
            HWREG(MEMCFG_BASE + MEMCFG_O_LSXINIT)  |= MEMCFG_SECT_NUM_MASK &
                                                      ramSections;
            break;

        case MEMCFG_SECT_TYPE_GS:
            HWREG(MEMCFG_BASE + MEMCFG_O_GSXINIT)  |= MEMCFG_SECT_NUM_MASK &
                                                      ramSections;
            break;

        case MEMCFG_SECT_TYPE_MSG:
            HWREG(MEMCFG_BASE + MEMCFG_O_MSGXINIT) |= MEMCFG_SECT_NUM_MASK &
                                                      ramSections;
            break;

        case MEMCFG_SECT_TYPE_MASK:
            //
            // Initialize all sections.
            //
            HWREG(MEMCFG_BASE + MEMCFG_O_DXINIT)   |= MEMCFG_SECT_NUM_MASK &
                                                      MEMCFG_SECT_DX_ALL;
            HWREG(MEMCFG_BASE + MEMCFG_O_LSXINIT)  |= MEMCFG_SECT_NUM_MASK &
                                                      MEMCFG_SECT_LSX_ALL;
            HWREG(MEMCFG_BASE + MEMCFG_O_GSXINIT)  |= MEMCFG_SECT_NUM_MASK &
                                                      MEMCFG_SECT_GSX_ALL;
            HWREG(MEMCFG_BASE + MEMCFG_O_MSGXINIT) |= MEMCFG_SECT_NUM_MASK &
                                                      MEMCFG_SECT_MSGX_ALL;
            break;

        default:
            //
            // Do nothing. Invalid ramSections. Make sure you aren't OR-ing
            // values for two different types of RAM.
            //
            break;
    }

    EDIS;
}

[参考译文] TMS320F28P550SG：在具有可变频率交流的 DCL 库中使用软件锁相环

admin — Mon, 09 Mar 2026 16:28:56 GMT

Other Parts Discussed in Thread: TMS320F28P550SG

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器件型号： TMS320F28P550SG

尊敬的 TI 团队：

我正在使用 TMS320F28P550SG 构建图腾柱 PFC 系统、需要在可变交流频率下运行。我计划根据一个 TI 示例设计、使用软件锁相环库函数来帮助控制此系统。

在我看到的 TI 示例中、所有这些都设计为在 50Hz 或 60Hz 的正常交流频率下运行、对于该频率、SPLL 应该运行良好。但是、我需要在交流频率（在大约 2：1 的范围内变化）下实现良好的 PLL 性能、并担心这可能会在交流频率的极端条件下影响 PLL 性能。

您能否就变频运行时我可能需要考虑的权衡提供任何指导、以及需要注意的事项。交流频率只会非常缓慢地更改频率（以秒为单位）。

非常感谢、

Iain

[参考译文] TMS320F280039：多少次 XRSn？

admin — Mon, 09 Mar 2026 14:47:05 GMT

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器件型号： TMS320F280039

您好的团队、

我向我的客户询问这个问题。

我的客户将下拉 XRSn 引脚以实现硬件复位

我的客户想检查 XRSn 如何影响器件的寿命：
1. XRSn 复位多少次后、器件将失败？

2.经过多少年后,设备会出现故障?

Thansk 等待您的答复

BRS

Shuqing

[参考译文] F29H850TU：F29H850TU (CPU3-EVM) 多 CPU：调用 ePWM/GPIO driverlib API 时、SOM 主环路停止进展（单步执行时有效）

admin — Sun, 08 Mar 2026 12:22:48 GMT

Other Parts Discussed in Thread: F29H850TU

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器件型号： F29H850TU

您好：

我正在使用的器件 F29H850TU 在上 SOM EVM (CPU1 + CPU3) 中运行。

CPU 到外设的配置似乎正确：我可以配置 独立 PWM 和 GPIO 对于 CPU1 和 CPU3、我还可以通过调试器/观察窗口（例如，更改 PWM 周期、切换 GPIO）来控制它们。

但是、我在上看到了异常的运行时行为 CPU3 ：

当我调用 driverlib 函数时、例如：
EPWM_setTimeBasePeriod (EPWM1XLINK_BASE、PERIOD_Cnt2)；
GPIO_writePin (myGPIO0_TEST_CPU3、1)；

中导出 CPU3 main.c （在主循环内部）while(1)、软件看起来“粘住“、主循环不再进程（例如，在内部停止更新的虚拟变量增量）while(1)。

观察结果

我有一个 RTDMA 中断 ISR 已配置。 ISR 按预期运行。
何时发生、以及 I 暂停 CPU3 、程序计数器始终位于内 RTDMA ISR （不在 NMI 中）。
如果我使用、则在停止后 单步执行 、CPU3 能够执行 driverlib 调用并继续。
然后按 继续/恢复 、则问题返回：CPU3 再次出现卡滞现象、并且中的代码while(1)未执行。

我尝试过的

编译器优化已禁用 CPU 启动。
我测试了 led_ex1_blinky_cpu1_cpu3_multi示例。即使我添加了额外的代码、该示例也可以正常运行。
我将工程设置与示例进行了比较、但到目前为止找不到根本原因。

您能否告知、是什么原因导致 CPU3 仅在调用某些 driverlib API (ePWM/GPIO) 时才停止在主循环中进行进程、而 RTDMA ISR 会继续运行？我怀疑缺少配置/设置（所有权，保护，中断/确认等）、但我目前卡住了。

此致、
Gökhan μ s

[参考译文] TMS320F280039C：CLA 和 C2000 对于浮点数具有不同的舍入模式

admin — Fri, 06 Mar 2026 18:59:29 GMT

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器件型号： TMS320F280039C

我知道、本质上、CLA 和 CPU 对于浮点数具有不同的舍入模式、CLA 会截断该数字、并且可以进行更改以匹配 CPU 的功能。

用于更改模式的汇编指令：
__asm（“ MSETFLG RNDF32=1“）；

我想知道 CLA 默认为截断而不是 CPU 舍入模式是否有具体原因。我主要关心的是启用 RNDF32 是否对 CLA 有任何有意义的性能影响。在我的应用中、额外的精度很有用、因此如果没有明显的缺点、我希望启用它。

该问题出现在 CLA 上执行的以下代码行中：

uint32_t pwmPeriodTicks_cla =(DEVICE_SYSCLK_FREQ /(float) freq)；

其中、我的 freq 等于 1000000、DEVICE_SYSCLK_FREQ 等于 C2000 ((uint32_t)(((20000000UL)* 48)/(2 * 4 * 1)))。

pwmPeriodTicks 在 CPU 中等于 120、但在 CLA 中变为 119。

我的问题是：
出于性能原因、默认的 CLA 截断行为是否有意为之？
启用 RNDF32=1 时是否会造成任何有意义的性能损失？
是否作为保持 CLA 和 C28x 结果一致的建议方法启用 RNDF32？

[参考译文] MSPM0G1505：厚度

admin — Fri, 06 Mar 2026 15:51:26 GMT

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器件型号： MSPM0G1505

尊敬的您好

请为以下带有 MPN-的零件提供厚度（以 mm 为单位）

MSPM0G1505SRGZR

TPS53830RWZR

[参考译文] F28377D-SEP：如何为 C28 内核实现 QAC？

admin — Fri, 06 Mar 2026 15:26:14 GMT

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器件型号： F28377D-SEP

您好的团队、

我向我的客户询问这个问题。为了证明其代码符合 MISRA-C2012 要求、客户使用了 QAC 进行证明。

但 QAC 不支持 C28 内核、如何证明 c28 代码符合 MISRA-C2012 要求？

BRS

Shuqing

[参考译文] TMS320F28377D：在引导时、XCLKOUT 是否从引脚 A16 输出？

admin — Fri, 06 Mar 2026 14:28:11 GMT

Other Parts Discussed in Thread: C2000WARE

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器件型号： TMS320F28377D
主题： C2000WARE 中讨论的其他器件

您好、

SCI 引导期间 XCLKOUT 输出什么？

INTOSC2？如果是、ROM 引导代码是否将引脚配置设置为从默认设置为 GPIO73 的引脚 A16 输出 XCLKOUT？

客户使用的是 F28377DZWTT。

此致、

英明

[参考译文] TMS320F28388D：CLA 调试问题

admin — Fri, 06 Mar 2026 12:13:57 GMT

Other Parts Discussed in Thread: TMS320F28388D

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器件型号： TMS320F28388D

TI 团队大家好、

Iam Nikileshwar。 IAM 使用 TMS320F28388D C2000 控制器进行 UPS 说明。我正在 CLA 中读取并执行 RMS 计算并将其发送到 CPU。

首先、即使 iam 在代码中启用了__mdebugstop ()、调试也不会在 CLA 任务中停止。 CLA 显示在调试页面中运行。

请帮助我纠正问题,因为我不能理解问题在哪里。

请找到图片。

提前感谢、

v Nikileshwar

[参考译文] TMS320F28P650DH：如何将 asm 文件中的结构用于 CLA？

admin — Fri, 06 Mar 2026 09:43:02 GMT

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器件型号： TMS320F28P650DH

尊敬的专家：

我有一个与相关问题类似的问题。

当我尝试将.asm 文件中的结构用于 CLA 时、会发生以下错误：

[E0300]以下符号未定义

asm 文件就像

报头如下所示：

工程是 attachedtestCode.zip

您能帮忙研究一下吗？

[参考译文] C2000WARE：C2000 电流共享特性

admin — Fri, 06 Mar 2026 07:31:31 GMT

Other Parts Discussed in Thread: UCD3138

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器件型号： C2000WARE
主题中讨论的其他器件： UCD3138

您好：

我想问、是否有任何具有 UCD3138 或类似电流共享功能的 C2000 系列解决方案？

如果是、有哪些相关的解决方案或应用手册、参考设计等？

谢谢你

[参考译文] TMS320F280039C："；如何在向上/向下模式下清除软件跳闸区后在 TBCTR = CMPA 下启动 ePWM 输出？"；

admin — Fri, 06 Mar 2026 06:05:54 GMT

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https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/1623425/tms320f280039c-how-to-start-epwm-output-at-tbctr-cmpa-after-clearing-a-software-trip-zone-in-up-down-mode

器件型号： TMS320F280039C

我正在测试我的应用、面临与启用和禁用 GPIO 引脚上的 PWM 脉冲相关的问题。

我的要求是禁用 PWM 输出 仅在 GPIO 引脚电平上 、同时保留 原始 PWM 生成在内部运行 。

在初始化过程中、我已经配置好了 EPWM1A 和 EPWM1B 之间的互补和死区 。我的预期情况类似、我需要禁用 PWM 时的情况 两个输出变为低电平 。

最初、我尝试使用 AQCSFRC 寄存器进行配置 强制输出。但是、由于逆变器/死区配置、一个输出变为 高电平 另一侧 驱动至低电平 、这对于我的应用程序来说是不可接受的。

因此、我开始使用 软件跳闸区 来禁用 PWM 输出。

我现在看到的问题是、当我出现这种情况时 重新启用 PWM 、脉冲从 A 开始 采集时间为 8 个随机点 。

我希望 PWM 的电压 当 TBCTR = CMPA 时完全启动 。

原因是我使用的是 中心对齐（向上/向下）模式 、并且在上配置了切换事件 比较值 。因此、在 CMPA 处启动 PWM 对于正常运行非常重要。

我的问题是：

确保这一点的最佳方法是什么 当 TBCTR = CMPA 时、PWM 输出完全恢复 清除软件跳闸后？
是否有针对的推荐方法 在 GPIO 电平上干净地启用/禁用 PWM 输出、同时保持 PWM 模块在内部运行 ？

任何建议或最佳做法都会有所帮助。

[参考译文] TMS320F280039C：F280039CSPZ 软件下载和启动问题

admin — Fri, 06 Mar 2026 04:35:51 GMT

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https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/1623394/tms320f280039c-f280039cspz-software-download-and-startup-issues

器件型号： TMS320F280039C

尊敬的团队：

故障现象：下载程序后、F280039C 在再次上电时未正常运行。

解决方案：将 F280039C 引导选项配置为通过下载程序刷写引导、然后将其重新上电、F280039C 可以正常运行。

问题分析：在 F280039C 的文档中（如下所示）、如果未配置引导模式、它最终将切换到闪存引导。

由于 F280039C 的外设硬件电路未配置引导模式、因此会根据文档将其设置为闪存引导；但实际上、当我们在这一批次中生产超过 500 个时、有 5 个异常 PC 无法正常启动。

请帮助分析原因以及我们理解的文档中表达的含义是否准确。