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https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1053163/cdcm6208-single-end-input-clock
大家好、
在将单端时钟输入到次级 基准输入时、如何终止 SEC_REFN？
是否应使用1k Ω 电阻器将其下拉？
此外、是否还应将 PRI_REFN 下拉1k Ω？
此致、
Itoh
Itoh-San、您好！
请将未使用的输入引脚保持断开状态。
73、 Timothy
您好、Timothe-San、
https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/283561/termination-of-unused-clock-inputs-on-cdcm6208
在上面的线程中、提到了可以使用1k Ω 电阻器上拉/下拉未使用的引脚。
使用单端时钟是否不同？
你是对的。 我在另一个线程中找到了保持打开的建议。 让我仔细检查一下。 当然、使用上拉/下拉时、您不会出错、因为您可以始终不填充组件。
无需放置任何其他元件即可驱动 CDCM6208单端。 唯一的要求是数据表中列出的 VIH/VIL 电平。
当未使用且输入缓冲器断电时、无需任何偏置、输入可保持悬空。
如果使用了输入、但没有时钟、则输入确实会产生迟滞、以防止数据表中列出的抖动。 只有当噪声过大、超过迟滞电平、才会在相反引脚上增加上拉/下拉电阻。 您需要将偏置在较低电平的引脚上的下拉电阻器放置-我不确定是哪个引脚。
