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[参考译文] ADC09DJ1300-Q1:ADC09DJ1300:Ta =–20℃ 时出现 SPLL 警报导致 TRIGOUT 时钟故障(违反数据表规格)

Guru**** 2797575 points

Other Parts Discussed in Thread: ADC09SJ1300, ADC09DJ1300

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1617359/adc09dj1300-q1-adc09dj1300-spll-alarm-at-ta--20-causes-trigout-clock-failure-datasheet-specification-violation

器件型号: ADC09DJ1300-Q1
主题中讨论的其他器件: ADC09DJ1300、ADC09SJ1300

您好、专家

我们在 Ta=ADC09DJ1300 时遇到一个严重问题–20℃。
SPLL 警报频繁发生、会导致完全的 TRIGOUT 时钟中断。

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1.违反数据表规范
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数据表状态:工作温度–40℃ 至+125℃(1 级)
我们的观察结果:Ta =–20℃ 时出现器件故障(完全在规格范围内)

www.ti.com/.../adc09dj1300-q1.pdf

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2.问题概述(参见附件 1)
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温度循环测试((–20℃⇔<xmt-block1>+50℃</xmt-block>、1740 分钟):+50℃:
-在 Ta=SPL:–20℃ 报警每 15 分钟发生 4-12 次(平均:7 次)
-重现性: 100%在 4 个设备上测试:
 •3 个 ADC09DJ1300(相同批次)
 •1 个 ADC09SJ1300(不同的产品型号)
 所有四个器件在 Ta=SPLL 锁定损耗行为均相同–20℃。

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3.报警信号验证(见附件 2)
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Ta =–20℃ 时的示波器捕获:
- CH1(黄色):GTX-CPLL 锁定信号
- CH2(绿色):ADC-SPLL 警报(FPGA 监控)
通道 3(蓝色):ADC CALSTAT 引脚输出

干净的信号边沿确认这不是外部噪声或功率问题。

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4、关键系统影响(参见附件 3)★最重要
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当发生 SPLL 警报时、TRIGOUT±时钟 (390.625MHz) 完全停止:

测量信号:
- CH1(黄色):GTX-CPLL 锁定信号   
- CH2(绿色):管理 RX 用户时钟/2 (78.125MHz)
-通道 3(蓝色):TRIGOUT±输出 (390.625MHz)→在警报期间停止

这不仅仅是一个警报 — 它是整个系统故障。

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5、消除外部因素
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电源质量(多级稳压设计):
  
 电压调节架构:
 •稳定电源→24V
 •24V→5V 直流/直流转换器
 •5V→拆分为两个独立路径:
   路径 1:5V→2.5V 直流/直流转换器→LDO1→1.9V(对于 ADC、为 VPLL19、VTRIG19、VREFO、VA19、VD19)
   路径 2:5V→2.1V DC-DC→LDO2→1.1V(对于 ADC、为 VA11、VD11)  
  
 安装在以下位置的去耦电容器:
 •5V 输出级
 •1.9V 输出级
 •1.1V 输出级
  
 在 ADC 电源引脚处测得的纹波:
 •1.9V 电源轨:<10mVpp
 •1.1V 电源轨:<10mVpp
  
 其他验证:
 •独立电源路径(每个电源轨有独立的直流/直流)消除了  
   1.9V 和 1.1V 电源之间的串扰
  
 ->非常干净和稳定的电源已确认

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6、结论
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内部 SPLL 设计问题导致低温下时钟输出故障。
可能存在 VCO 或带隙基准温度系数问题。

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7.问题
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1.这是已知的缺陷吗?
2.是否有任何勘误或应用说明?
3.建议的解决方法?
4.是否提供修订版的器件版本?

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8,紧急性 — 安全关键
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-产品配送给汽车客户
-安全系统应用 — 时钟故障是不可接受的
-需要立即响应管理报告

请在一周内升级到设计工程部门并提供解决方案。

谢谢你。

附件:
1_ADC09DJ1300_SPLL_ADCL.png Temperature_Cycle_(1740 分钟测量数据 Alarm_Count)
1_ADC09DJ1300_SPLL_ADCL.png Temperature_Cycle_ Alarm_Count2_ADC09DJ1300_SPLL_ADC39_ Alarm_Waveform_CALSTAT_Out.png

2_ADC09DJ1300_SPLL_ADC39_ Alarm_Waveform_CALSTAT_Out.png
3_ADC09DJ1300_TRIGOUT_TRIGOUT_ADC39_ Clock_Interruption_during_SPLL_Alarm.png(关键证据)

3_ADC09DJ1300_TRIGOUT_ADC39P_ADC3910_ Clock_Interruption_during_SPLL_Alarm.png

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    Hi Mitsuo、

    我们正在对设计进行检查。

    您能否告知我们、您是否在温度范围内监控器件的采样时钟输入?

    如果采样时钟的信号完整性在整个温度范围内有问题并且不符合数据表规范、这将纹波到 SPLL 和 TRIGOUT+/-。

    此致、

    Rob

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    您好、Rob、

    感谢您的支持。

    否、我们没有直接监测 CLK±。 我们也没有在整个工作温度范围内监控它。
    由于测量限制、我们改为在 FPGA 端监测 PLLREFO±。 当时看起来很正常。 不过、该测量也仅在室温下进行。
    我们需要一些时间来考虑我们的测量方法。 请给我们更多时间。

    顺便说一句,我想分享详细的数据作为补充信息。 但是、由于我们的内部政策、我们需要使用我们公司指定的安全文件传输服务。 准备就绪后、我们将与 TI 日本合作共享数据。 我们愿在这里继续就这个公开论坛进行技术讨论。

    感谢您的理解。

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    Hi Mitsuo、

    准备就绪后、请联系当地的 TI 支持人员、他们可以让我们重新发送一封更正式的电子邮件、帮助解决问题。

    我现在要关闭这篇文章。

    此致、

    Rob

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    您好、

    Rob Side 有一些问题。

    [1]这种情况是否仅在低温下发生?

    [2]问题是在室温下还是高于室温下消失?

    [3]这种情况是否会在多个电路板上发生?

    [4]每块电路板上是否只有一个 ADC 器件?

    此致、
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