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[参考译文] ADC12D1620QML-SP:TSW12D1620评估模块

Guru**** 536590 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1125838/adc12d1620qml-sp-tsw12d1620-evaluation-module

器件型号:ADC12D1620QML-SP

您好!

我正在评估两 个 TSW12D1620评估板。 我 在两张卡上都看到了频率为400MHz 时的固定-50dBm 杂散、输入或输入了1.6GHz 时钟、这让我感觉这是我在设置中遇到的问题。 我正在遵循评估指南、与我在步骤2.13中所做说明唯一的偏差、其中涉及要选择的特定文件。 我在文件夹中找到了措辞类似但略有不同的文件、我不确定这些问题是否存在。 由于我在400MHz 下看到固定杂散、我看到我的147.77MHz 载波与杂散跳动、因此在我的频谱中、我看到了杂散+/- N 载波的载波和一组产品。 我在所有情况下都使用外部时钟。

在哪里可以找到以下文件、以确保我按照指南中所述的所有说明进行操作?

步骤2.13

TSW14DL3200_FIRMWARE_COMPONENT_MODE_800M.bin (我在 文件夹中只找到了一个名为"TSW14DL3200_firmware_component_mode"的文件

ADC12D1620_NonLSPSM_demux_nonDES_DCLK90_DDR  (我找不到此特定文件、但找到的是该典型文件版本、名称中未提及 DCLK90)

谢谢、

Mickel

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    您好、Mickel、

    您能否发送显示杂散的频谱的屏幕截图。  

    看到杂散时、您是否尝试运行过校准?  

    如果不是、这里是如何进行校准的。

    1.转到 GUI 上的"Control"选项卡。

    2.单击校准位0到1 以触发校准。  

    此致、

    Neeraj

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    您好!

    您能否向我提供以下文件、以便我可以排除这些文件不是我的问题的原因。

    TSW14DL3200_FIRMWARE_COMPONENT_MODE_800M.bin  

    ADC12D1620_NonLSPSM_demux_nonDES_DCLK90_DDR

    我有可以发送的图片、但我很困惑如何附加到该论坛。  

    谢谢、

    Mickel

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    您好、Mickel、

    我已附上请求的文件。  

    e2e.ti.com/.../TSW14DL3200_5F00_FIRMWARE_5F00_COMPONENT_5F00_MODE_5F00_800M.BIN

    e2e.ti.com/.../ADC12D1620_5F00_NonLSPSM_5F00_Demux_5F00_DES_5F00_DCLK90_5F00_DDR.ini

    要附加文件、请单击插入、然后单击上传按钮加载苍蝇

    此致、

    Neeraj

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    您好!

    我附了以下照片。 第一幅图显示了未施加射频时的采样信号(您看到400MHz 音调)、随后应用了约-30dBm 的147.77MHz 射频信号。 我将射频信号移10MHz、您将看到波形中的产品/杂散如何在高侧产品降10MHz 的频率中跟踪一对应的情况。 我有一个11dBm 1.6GHz 时钟信号进入 Devclk、我仅驱动其中一 个单端 AIN (I channel)输入、所有其他射频连接器保持开路、不会与50 Ω 负载端接。 我使用频谱分析仪测量了输入结果、发现在-40dBm 时存在250MHz 的泄漏、以及大约-60dBm 或更低的500、750、1GHz 的泄漏。 请记住、这是在未连接1.6GHz 时钟的情况下进行的、因此我假设这是来自 ADC 的噪声从 J21返回。 我有两个评估板、它们都显示了相同的问题。 有什么想法吗?  

    我将尝试您发送给我的文件、看看这是否能解决问题、但我可以保证时钟信号和射频输入是干净的、因此这是 ADC 的一些内部泄漏问题、FPGA 固件问题或其他问题。 添加这些文件后、我应该与用户指南中的说明完全相同。

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    请查找所附文件。  

    e2e.ti.com/.../ADC12D1620_5F00_NonLSPSM_5F00_Demux_5F00_DES_5F00_DCLK90_5F00_DDR.allow

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    您好 Neeraj。 我相信我现在已经开始工作了。 我的主要问题是、我将 ecen 引脚拉高、因此基本上无法使用 EVM GUI 控制硬件、我看到的大多数杂散都是由于采样数据被错误地解释而导致的、认为它在 DES 或非 DES 中、 SDR 或 DDR 等

    我的最后一个请求是、您能否将文件发送给我?  

    ADC12D1620_NonLSPSM_Demux_nonDES_DCLK90_DDR.ini

    此外、在哪里可以找到这些文件、因为我可能希望在不同的多路信号分离器、DDR/SDR 和器件的各种模式之间播放?

    谢谢、

    Mickel。

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    您好、Mickel、

    我在上一个帖子中发送了该文件。  

    所有其他文件应位于 PC 上的以下位置。  

    C:\Program Files (x86)\Texas Instruments\High Speed Data Converter Pro\14DL3200 Details\ADC 文件

    此致、

    Neeraj

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    您发送了 DES 版本。 我需要非 DES 版本。 我还知道文件夹的位置、但在我的目录中、最初只有3种不同类型。 你给我的那一个选择给了我第四个选择,但我不确定我是否应该有更多的选择。 ADC 应存在多少个文件。 我正在使用没有互联网的封闭系统、因此我不确定是否没有更新。

    谢谢、

    Mickel

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    给你。  

    e2e.ti.com/.../ADC12D1620_5F00_NonLSPSM_5F00_Demux_5F00_nonDES_5F00_DCLK90_5F00_DDR.allow