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[参考译文] ADC128D818:SCL 的逻辑1输出电压和频率

Guru**** 2511985 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/919439/adc128d818-logical-1-output-voltage-and-frequency-of-scl

器件型号:ADC128D818

大家好、

当 VDD=3.3V 时、判断电压 H 和 L 是多少?
在数据集中、我只能看到 VOUT (0)逻辑0输出电压最大值为0.4V、但没有 VOUT (1)。
I2C 是否仅在四种速度下可用? 它是否可以在 SCL 的频率为25kHz 或50kHz 时使用?

此致、
Tom Liu

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    Tom、

    作为输出线路、只要有一个上拉电阻器、VOUT (1)就会一直上升到 VDD。

    /INT 是一个开漏连接(与 SDA 和 SCL 相似)。 要激活、NMOS 漏极将在/INT 线路上下拉以创建逻辑0。 为此、您需要一个上拉电阻器。 在规格中、条件显示漏极电压将在负载为5mA 时拉至低于0.4V、V+为4.5V。

    但是、/INT 不会被器件推高。 /INT 线路仅由外部上拉电阻器上拉。 这就是为什么没有关于输入作为输出上拉的高电平的规格。

    I2C 速度在中受电气特性中列出的 SCL 周期的限制。 您可以在此处看到:

    最大时钟周期为100us、最小时钟周期为2.5us。 这意味着 SCL 速度介于10kHz 至400kHz 之间。

    吴约瑟