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[参考译文] ADC32RF54:以 x4取平均值的方式输出数据速率

Guru**** 651100 points
Other Parts Discussed in Thread: ADC32RF54, ADC32RF55
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1178315/adc32rf54-output-data-rate-at-x4-averaging

器件型号:ADC32RF54
主题中讨论的其他器件: ADC32RF55

您好!

我对 ADC32RF54在各种平均设置下的最大数据速率有疑问。

数据表在"电气特性"章节中指出、如果使用 x2取平均值、采样率限制为2.6GSPS。  在 JESD204B 章节中、可以看到、对于 x2及以上版本、输出格式为16位、而不是12位。

我想知道的是-使用 x4取平均值时、对数据速率有什么影响、无论是在 ADC 的输出上获得的实际采样率、还是数据通道的位速率。 接下来-除了功耗增加和布局复杂性之外、使用 x4还是 x2有任何缺点。

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    您好、Semion、

    正确、输出从14位变为16位。 12位输出仅适用于采用8-2-8-20的旁路模式的 ADC32RF55 (3GSPS)器件、该器件将在未来几周内在线激活。 EVM 上的器件是2.6GSPS 器件。

    功耗增加、路由复杂性增加和驱动电平增加是实现4倍平均的不利因素。 在平均模式下、输入信号电压与 ADC 输入保持一致并线性增加、但噪声仅通过平方和根方法增加。 因此、平均每2^N、噪声就会降低3dB*N 在4倍平均中、与1倍平均相比、噪声应提高约6dB。 模拟输入带宽相当、但频率响应的形状可能略有不同。 由于前端匹配、滚降可能更早几个100MHz、并且线性度可能会在峰值之前进一步下降。 这应该是唯一的区别。 校准和 DDC 等其他功能将保持不变。

    谢谢、Chase

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    太棒了!

    我们的应用不需要该器件的全模拟带宽、因此 x4应该是最佳模式。

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    Semion、

    我不确定你们是否打算使用任何抽取模式、但如果不需要完整的 FS/2瞬时带宽、抽取将 通过处理增益提高性能。 对于每2^N 的抽取、带外噪声减少1/2^N、增加的处理增益将为3dB * N。抽取模式的其他优势包括降低输出数据速率(与抽取因子成正比)以及减少 JESD 通道数。 这意味着、由于我在上周末通过电子邮件提到了 JESD 通道映射多路复用器、路由可能会变得稍微简单一些。 如果不打算使用 DDC 旁路模式、则只需选择最有利的 JESD 通道即可路由。

    谢谢

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    我们确实需要完整的2.4GSPS 采样率、因此 无法实现基于 ADC 的抽取。

    稍后、我们将在 FPGA 中使用它。

    除了使用多路复用器或 FPGA 交换通道极性的功能外、我们还必须对所有通道进行布线。

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    当然可以。

    在所有通道布线的情况下、在线路下测试抽取模式不会出现问题、因此您可以根据需要将一些处理从 FPGA 转移到 ADC。

    限制您在1.2GHz IBW 下旁路模式的最大信号带宽/范围是多少? 该器件可实现的最低抽取率为/4、因此300MHz 将是新的 IBW。 如果信号处于300MHz 范围内、您仍然可以在2.4GSPS 下采样、但只需发送300MHz 的数据值而不是1.2GHz 的数据值、并且仍然可以使用 NCO 到达任何高达 Fs/2的300MHz 窗口。 我只是想提供一些额外的信息、因为对于我谈到的许多人、这是我们的 ADC 第一次遇到抽取。

    此致

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    这种应用相当合适。

    让我们通过电子邮件继续