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[参考译文] DP83TG720R-Q1：与 RGMII 时序相关的输入和输出电容差

admin
Guru**** 651100 points
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https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1181283/dp83tg720r-q1-rgmii-timing-related-input-and-output-capacitance-differences

器件型号：DP83TG720R-Q1

专家您好！

我发现 Tx_D0/Tx_D1/Rx_D2/Rx_D3  RGMII 数据线的 RGMII 时间要求(输入电容和输出电容)与其他数据线不同，我的问题是为什么差分 TI 设计行为在端口上？

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    TI__Guru**** 651100 points
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    您好、Jing、

    这是由 PHY 的内部架构造成的。

    谢谢、

    Evan

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    TI__Guru**** 651100 points
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    这是否是 IBIS 模型中已经考虑过的最坏情况？

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    TI__Guru**** 651100 points
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    回顾720的 IBIS 仿真、它们似乎描述了每个版本器件的最佳、最差和标称情况。

    谢谢、

    Evan