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[参考译文] LSF0108-Q1:一个侧的高电平输出电压被 VrefA 钳位

Guru**** 1947850 points
Other Parts Discussed in Thread: LSF0108, LSF0108-Q1
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1168393/lsf0108-q1-the-high-level-output-voltage-of-a-side-is-clamped-by-vrefa

器件型号:LSF0108-Q1
主题中讨论的其他器件:LSF0108

尊敬的 TI 支持团队:

我们在使用 LSF0108-Q1电平转换器时遇到了一个问题。 下面是原理图。 我们将 VrefA 连接到1.2V 源。 VerfB 和 EN 通过一个100千欧电阻器连接到3.3V 电源。 A 侧到 B 侧的信号正常。 但我们在将信号从 B 侧转换到 A 侧时遇到了问题。 在我们的案例中、侧端口连接到 VDDIO 可以为1.8V 或2.5V 或3.3V 的 FPGA。 但 B 侧端口连接到固定的3.3V DUT。 对于 SDA 等双向引脚、从 A 侧到 B 侧的转换正常。 但是、当信号方向相反时、如果 B 侧输入和高电平信号、则 A 侧输出将钳位在1.2V 的 VrefA 上。 但我们有一个将引脚上拉至 FPGA 的 VDDIO。 我们所期望的是、A 侧的高电平输出应取决于上拉源。 我们已经观看了 LSF 系列电平转换器的视频。 我们认为、根据 LSF0108的结构、A 侧输出高电平电压不应被 VrefA 钳位、如下图所示。 您对此问题有什么看法吗? 谢谢!

谢谢、此致、

沙东

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    正确的做法是、A 侧电压应由上拉电阻器确定。

    会吸收流经上拉电阻器的电流。 A 侧是否有任何下拉电阻器或任何其他负载?

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    大家好、Clemens、

    没有下拉电阻器。 负载是另一个 LSF0108 A 端口。 整个设置如下所示。 谢谢!

    谢谢、此致、

    沙东

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    在该图中、A 引脚上的信号上拉至1.8V。因此、高电平电压预计为1.8V

    在两个 B 引脚(FPGA 和 DUT2)上、信号上拉至3.3V。您在那里测量的是什么?

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    大家好、Clemens、

    我们直接在 LSF0108 A 端口引脚上测量。 我们还希望高电平电压应为1.8V。 它在之前的设置中工作。 但是、当我们按如下方式更改设置时、我们会将端口的上拉源更改为高于 VerfA 的电源。 高电平输出将被 VrefA 钳制。 谢谢!

    谢谢、此致、

    沙东  

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    如果 A 引脚电压为1.8V、则 VDDIO_3.3V 提供电流、流经上拉电阻器、然后被灌入某个位置。 该原理图未显示该电流可能被灌入的任何位置。

    两个 B 引脚上的电压是否正确? VrefA 和 VrefB 是否具有正确的电压(VrefB 应比 VrefA 高0.6V 左右)?

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    大家好、Clemens、

    B 侧的电压正确。 您可以在原理图中看到、对于两个 LSF0108、VrefB 都比 VrefA 高1.6V。 我们还对电流流向何处感到困惑。 你对此有什么想法吗? 谢谢!

    谢谢、此致、

    沙东

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    没有明显的解释。 DUT#1可能会将线路拉低、或者在某个地方可能存在一个焊接桥、或者 LSF 引脚排列不正确。

    是否可以测量从 VrefA 流出的电流大小?

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    您好,Chaodong,

    此外、 请参阅 LSF0108-Q1:A 侧的输出电压受 VrefA 限制

    此外、您能否帮助确认线路的数据速率频率不会拉高? 谢谢。

    此致、

    Michael。

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    大家好、Clemens、

    我们发现了灌入的电流。 返修期间、电阻器意外连接到端口 A。 感谢你的帮助。

    谢谢、此致、

    沙东  

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    您好、Michael、

    感谢你的帮助。 我们已经找到原因。

    谢谢、此致、

    沙东