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器件型号:SN74LVC2G74-Q1 工具与软件:
大家好、专家。
我 预期 当器件上电时 Q 输出为低电平,因此我使用 RC 延迟电路使 CLEAR 引脚首先为低电平。 此设计能否确保低通电输出? 以及应选择多大的延迟?
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我 预期 当器件上电时 Q 输出为低电平,因此我使用 RC 延迟电路使 CLEAR 引脚首先为低电平。 此设计能否确保低通电输出? 以及应选择多大的延迟?