[参考译文] TPS23756：TSPS23756 CTL 引脚理解

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https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/718420/tps23756-tsps23756-ctl-pin-understanding

器件型号：TPS23756

嗨、大家好

至于 CTL 引脚功能，数据表：CTL 是脉宽调制器(PWM)的电压控制环路输入。将 VCTL 拉至低于 VZDC 会导致 GATE 停止开关。将 VCTL 增加到高于 VZDC (0占空比电压)会提高开关 MOSFET 编程的峰值电流。在大约 VZDC +(2×VCSMAX)时请求最大(峰值)电流。从 CTL 到 PWM 比较器的交流增益为0.5。从 CTL 到 ARTN 的 kΩ 分频器约为100 μ s。

因此、在我看来、CTL 引脚用于控制 PWM 脉冲。它与电流限制有关。但我很困惑该引脚的工作原理是什么？ Vzdc 的含义是什么？或者为什么是 Vzdc？当 Vzdc 高于 Vctl 或低于 Vctl 时、条件是什么？请解释 CTL 的工作原理。

感谢您的任何反馈。

谢谢

Vincent

7 年多前

0 admin 7 年多前

TI__Guru**** 2494635 points

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尊敬的 Vincent：

我正在研究您的问题、并将在本周晚些时候向您提供详细的回答。

谢谢、
Tom

0 admin 7 年多前

TI__Guru**** 2494635 points

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您好 Vincent、

我目前正在深入探讨您的问题、并希望确保我正确理解您的帖子。我准备回答以下问题：

1. CTL (控制环路输入)引脚如何工作？
2.什么是 Vzdc (零占空比阈值)？为什么它很重要？
3.当 Vctl > Vzdc 时会发生什么情况？当 Vctl < Vzdc 时会发生什么情况？
4. CTL 和 Vzdc 与峰值电流限制有何关系？

如果您的帖子中有一部分您也想回答、请告诉我。

－Tom

0 admin 7 年多前

TI__Guru**** 2494635 points

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您好 Vincent、

2。 Vzdc (零占空比阈值)是 TPS2's PWM 控制器用来将 CTL 信号与之进行比较的1.5V 带隙基准。 PWM 控制器使用这个恒定带隙来大概了解输出电压是否在稳压范围内。

1、3、4。当 Vout 高于预期输出电压时、反馈环路中的光耦合器将导通更多、从而导致 Vctl 降低。如果 Vctl 降至 Vzdc 以下、则初级侧 FET 关闭、从而结束占空比、因为次级侧不需要额外的电压即可保持在调节范围内。

当输出电压低于预期输出电压时、光耦合器的导通电流较低。因此、Vctl 保持高于 Vzdc、因此 PWM 控制器保持初级侧 FET 导通、从而延长占空比。占空比越长、初级侧峰值电流就越高、因为变压器初级侧的电感器变得越短、直流电流的施加时间越长。峰值电流可以根据变压器的电感值或电感值分别减小或增大。

谢谢、
Thomas Amlee

0 admin 7 年多前

TI__Guru**** 2494635 points

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谢谢 Thomas。很好的解释。

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