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[参考译文] LP8733:通过 EN 引脚启用和禁用控制

Guru**** 1876410 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1216424/lp8733-enable-and-disable-control-with-the-en-pin

器件型号:LP8733

我们的客户使用的是其电路板上带有 AM243x 的 LP87334D。

LP87334D 无法在通过 EN 引脚关断后重新启动。

为什么在关断时 PGOOD 失效?

在关断期间输出电压监控是否工作?

完成关断的条件是什么?

是否所有电源输出都需要低于特定的阈值电压才能完成关断?

通过 EN 引脚重新启动的条件是什么?

是否需要清除 PG_FAULT 寄存器中检测到的所有故障位才能通过 EN 引脚重新启动?

在关断完成后、是否需要等待一段特定的时间才能通过 EN 引脚重新启动?

此致、

大辅

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    您好、Daisuke、

    您能否分享 LP87334D 的原理图? 您还可以确认 EN 处于低电平的时间吗? 它看起来是~200ms、这是正确的吗?

    谢谢。

    丹尼尔 W

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    Daniel - San、您好!

    感谢您的答复。

    我能否用私人信息与您分享我们客户的原理图?
    如何向您发送私密消息?

    EN 为低电平的时间大约为200ms。

    此致、

    大辅

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    您好、Daisuke、

    我发送了朋友申请。 请接受它、然后您应该能够直接向原理图发送消息。

    谢谢。

    丹尼尔 W

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    Daniel - San、您好!

    感谢您的答复。

    我已经发送了一封私人信息、将我们客户的原理图与您分享、如果您能评论、我将不胜感激。

    此致、

    大辅

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    您好、Daisuke、

    感谢您分享原理图。 我将在接下来的2天内进行审核并提供反馈。

    谢谢。

    丹尼尔 W

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    尊敬的 Daisuke-San:

    我认为原理图中没有任何直接问题会导致此问题。 您能否提供 BUCK0、BUCK1、LDO0和 LDO1关闭的示波器截图?

    谢谢。

    丹尼尔 W

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    Daniel - San、您好!

    感谢您的答复。

    下面提供了每个电源输出的关断示波器快照。

    顺便说一下、即使 EN 引脚保持低电平超过10秒、它也没有通电。

    我们怀疑通过 EN 引脚关断不是复位因子、因此无法通电。

    在数据表的"7.3.7器件复位场景"部分中、介绍了以下两种复位方法、不包括通过 EN 引脚关断。

    •通过 RESET 寄存器中的 SW_RESET 位进行软件复位。
    •通过 VANA 电源进行欠压锁定(UVLO)复位。

    此致、

    大辅

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    您好、Daisuke、

    通过复位寄存器和 VANA UVLO 进行的复位是指器件数字内核的复位、而不是输出。

    您是否可以在断电期间检查 nINT 电平?

    您是否还能够通过 I2C 访问该器件?

    谢谢。

    丹尼尔 W

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    Daniel - San、您好!

    感谢您的答复。 很抱歉这么晚才回复。

    由 EN 引脚关断后、nINT 也会置位为低电平。

    通过 I2C 进行检查、设置 INT_TOP_1寄存器中的 OVP_INT。 而 VSYS (VCC_5V)在断电开始时似乎过压。

    在 SW_RESET 复位或清除 OVP_INT 后、EN 引脚上电成功。

    当 VSYS (VCC_5V)设置为约4.5V 试用时、不会设置 OVP_INT、然后通过 EN 引脚成功上电。

    此致、

    大辅

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    您好、Daisuke、

    感谢您的更新。 BUCK0和 BUCK1可能会主动放电到 VSYS、这会导致 VSYS 上升和过压。

    谢谢。

    丹尼尔 W

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    Daniel - San、您好!

    感谢您的答复。 很抱歉这么晚才回复。

    我们的客户会在5V 线路上放置较大的电容器。 他们也可以在下一个设计中将 FPWM 版本的反向转换器用于5V 电源。

    此致、

    大辅