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[参考译文] TPS65219:并联 LDO 通道、可提供更高的电流容量

Guru**** 1633940 points
Other Parts Discussed in Thread: TPS65219, TPS65219EVM
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1380329/tps65219-parallel-ldo-channels-for-higher-current-capacity

器件型号:TPS65219

工具与软件:

E2E 论坛、您好。

我们需要为空间受限的 FPGA 电力输送级提供极其紧凑的电源解决方案。

为此、我们需要~μ A 800mA 的流经 LDO*的电流(有关星号、请参阅下文)。 由于上述空间限制、拥有一个单独的 LDO 是不可取的。

我们将 TPS65219确定为我们很可能的目标器件、这也是因为它在通过 I2C 的电压和启动序列方面具有很高的可配置性。

我们的关键问题是、是否可以将 LDO1和 LDO2的输出组合在一起来产生所需的800mA 电流?

如果不能做到、是否有任何其他 TI 产品可以满足我们的要求?

  • 电压轨:
    • 输入:3.3V
    • 输出:
      • 1.8V、1.5A (通过直流/直流稳压器)
      • 1.2V、2A (通过直流/直流稳压器)
      • 0.85V、2.5A (最好是3A)
      • 1.8V、0.1A (通过 LDO*)
      • 0.9V、800mA 通过 LDO*
      • 3.3V、250mA (通过负载开关)
  • 可配置性:
    • 用于进行电压设置的 NVM
    • 用于启动和关断的 NVM
      • 优先选择像 TPS65219可能的配置那样的高粒度配置
    • I2C 接口
  • 尺寸:
    • 最大尺寸为7mm x 7mm
    • 所需最大高度为1mm

*如果输出波纹小于10mVpp、我们可以在这里使用直流/直流转换器、而不是 LDO

谢谢、此致、

Valentin Stümpert ć

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    尊敬的 Valentin:

    不建议组合 LDO 输出。 我会请器件专家来帮助您确定满足这些要求的最佳选择、因此希望您能在明天6月28日收到回复。

    此致、

    Matt

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    尊敬的 Valentin:

    感谢您使用 E2E。 根据您的消息中所述的要求、 TPS65219 似乎最合适。 该 PMIC 采用4x4mm 的小型封装、在大多数情况下、即使与分立式器件结合使用、它仍能提供尺寸经优化的电源解决方案。 我们可以根据您的应用要求帮助创建 TPS65219 NVM 配置文件、以便轻松对样片进行编程和评估。  

    PMIC 中的大多数集成-500mA 最高支持400mA LDO。 有些非常小的分立式器件可以配合其中一个 PMIC  800mA 来提供0.9V/GPIO 电源轨。 以下是一些示例: TLV757P (LDO)、 TPS62800 (小型降压稳压器)

    谢谢!

    Brenda

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    感谢 Brenda 的详细答复。

    借助您的建议、我可以使用 WEBENCH 工具找到一些适合0.9V/WEBENCH 800mA 电源轨的小型降压转换器。

    然而、观察 TSP65219的效率估算器、1.2V 和0.85V 电源轨工作点的效率会下降至80%…… 这是否可以通过选择特定元件来改进?

    或者、数据表中注明了 TP65219的最大电压纹波为20mV。 这是否可以通过输出滤波器进一步改善、从而我们可以改用独立降压转换器作为其中一个高电流轨的电源?

    您能在这里为我提供元器件选择方面的支持吗? 遗憾的是、WEBENCH 似乎不支持 TPS65219。

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    尊敬的 Valentin:

    PMIC 不在 WEBENCH 中 、但您可以使用 TPS65219效率计算器中的选项卡"Buck1"、"Buck2"、"Buck3"来形象化做出的假设。 可以根据您选择的电感器修改"Rind"参数。 单击"更新曲线"以更新计算值。 降压转换器的内部参数针对0.47 μ H 电感器进行了优化、但您可以降低电感器直流电阻以提高效率。 选择合适的电感器可能具有挑战性、通常取决于尺寸、磁芯材料和成本的权衡。 选择外部无源组件时、您可以使用 TPS65219EVM 作为参考。

    同样、对于输出电容、请选择具有低 ESR 的元件 以降低输出纹波。 如果您的应用不受空间限制、则还可以增加输出电容而不超过最大总电容(包括 SoC/FPGA 和外设)。

    谢谢!

    Brenda