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[参考译文] 66AK2H06:USB 时钟终端

Guru**** 2012440 points
Other Parts Discussed in Thread: 66AK2H14
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/900484/66ak2h06-usb-clock-termination

器件型号:66AK2H06
主题中讨论的其他器件:66AK2H14

您好!

这是原始帖子的附加问题。

客户观察到 USBCLK 上的过冲/下冲。
根据原始线程、在加载软件并初始化 SERDES 接口之前、不会终止 USBCLK。
客户已加载并初始化 USB 模块、现在合规性测试已通过。
但 USBCLK 波形仍然显示过冲/下冲。
如果客户在 USBCLK 上添加了100 Ω 终端、则过冲/下冲消失。
请参阅随附的 xls。
e2e.ti.com/.../USB_5F00_clock.xlsx
SERDES 将应用100欧姆端接、而外部不需要端接吗?
或者客户需要设置特定的寄存器或位来启用内部终端?

谢谢、此致、
田志郎一郎

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    Tashiro-san、

    如您所述、SERDES 软件在加载驱动程序时启用终端。  您说、加载驱动程序后 USB 合规性测试通过。  您附加了两个示波器捕获。  这些是在驱动程序加载并激活时获取的吗?  在加载驱动器之前、输入看起来是什么样子的?

    不建议使用外部端接。  该时钟的驱动源是什么?  源阻抗为100欧姆差分时、是否与 LVDS 或 LVPECL 兼容?

    Tom

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    Tashiro-san、

    您能回答我的问题吗?

    Tom

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    Tashiro-san、

    由于没有响应、我将关闭此主题。  如果要重新打开它、只需发布到此线程。  如果它被锁定、您可以打开一个新的线程并将它们链接在一起。

    Tom

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    您好、Tom、


    很抱歉耽误你的时间。
    我们上周在日本度假。
    请查看您的问题答案。

    >这些是在驱动程序加载并激活时获取的吗?

    上波形是驱动器加载并激活时的波形。
    器件(66AK2H)通过 USB 连接到 PC、并在 Windows 中正确识别。

    >在加载驱动程序之前,输入内容是什么样子的?

    客户比较加载驱动程序之前和之后的波形、但它们是相同的。
    我担心在客户代码中缺少一些启用 SERDES 终止的设置。
    您能否指出哪个寄存器和位启用 SERDES 端接?

    >此时钟的驱动源是什么? 源阻抗为100欧姆差分时、是否与 LVDS 或 LVPECL 兼容?

    时钟源侧低于;
    https://www.idt.com/jp/ja/document/dst/idt8slvd1208-33i-datasheet
    该源也用于 SYSCLK、ARMCLK、DDRACLK 和 PCIECLK。
    PCIe 初始化完成后、PCIECLK 会变得更干净。 只有 USBCLK 显示过冲/下冲。

    谢谢、此致、
    田志郎一郎

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    Tashiro-san、

    >>驱动程序加载并处于活动状态时是否执行了这些操作?

    上波形是驱动器加载并激活时的波形。 该器件(66AK2H)通过 USB 连接到 PC、并在 Windows 中正确识别。

     

    TI:我感到困惑。 您之前说过、一旦配置软件被执行、USB 合规性测试就通过了。 您在这里指出、显示反射的上波形捕获已捕获驱动器已加载并处于活动状态。 您是否说它在功能上符合失真时钟、但您的问题只是时钟信号的清洁度?

     

    >>该时钟的驱动源是什么? 源阻抗为100欧姆差分时、是否与 LVDS 或 LVPECL 兼容?

    时钟源侧低于;

    www.idt.com/.../idt8slvd1208-33i-datasheet

    该源也用于 SYSCLK、ARMCLK、DDRACLK 和 PCIECLK。

    PCIe 初始化完成后、PCIECLK 会变得更干净。 只有 USBCLK 显示过冲/下冲。

     

    TI:我需要的不仅仅是数据表。 我需要知道这个 LVDS 时钟扇出缓冲器和 USBCLK 输入之间的组件和电路连接。

     

    Tom

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    您好、Tom、

    第1点;
    是的、USB 工作正常、并且脏时钟(上波形)的合规性测试通过。
    客户的问题是无论是否加载了软件,波形都不会改变。
    他想知道他们的代码中错过了一些设置。

    第2点;
    我将离线向您发送客户原理图的一部分。

    谢谢、此致、
    田志郎一郎

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     Tashiro-san、

    我做了更多的研究。 我发现 USB IP 块与该器件上的其他 SERDES IP 块不同。 如您所见、《KeyStone II 架构串行器/解串器(SerDes)用户指南》(SPRUHO3A)中未提及此内容。 SERDES 参考时钟是要求在参考时钟正确终止之前执行软件驱动程序的时钟。 《KeyStone II 架构通用串行总线3.0 (USB 3.0)用户指南》(SPRUHJ7A)中介绍了 USB-SS 接口。  但是、我找不到任何针对基准时钟输入端接的软件控制的参考。  我知道66AK2H14器件上的 USB-SS 端口已通过合规性测试。  我希望我们使用客户看到的相同时钟通过测试。  由于它无需外部端接电阻器即可通过合规性测试、并且在添加外部电阻器时基准时钟信号仍然符合 LVDS 信号定义、因此客户可以选择添加外部端接或将其关闭。

    Tom

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    您好、Tom、

    我明白了。 我知道 USBCLK 串行器/解串器没有内部终端。
    从现有文件中很难找到这一信息。
    客户希望 TI 将此信息添加到某个位置。
    您能否更新数据表或用户指南?

    谢谢、此致、
    田志郎一郎

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    Tashiro-san、

    我们将提交一份请求、以更好地解释这一点。

    Tom