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[参考译文] AFE7903:如何使用 TI JESD204 IP 32位 TX/RX_LANE 数据宽度

Guru**** 1825110 points
Other Parts Discussed in Thread: AFE7900EVM, AFE7903
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/rf-microwave-group/rf-microwave/f/rf-microwave-forum/1328259/afe7903-how-to-use-ti-jesd204-ip-32-bit-tx-rx_lane-data-width

器件型号:AFE7903
主题中讨论的其他器件:AFE7900EVM

您好!  

我们一起测试 AFE7900EVM 电路板和 Xilinx ZCU102、

使用 TI JESD204 IP 参考设计的"ZCU102_AFE79xx_8b10b_10Gbps"文件夹中包含的设计文件。

我们已成功在 TX/RX_LN_DATA_WIDTH = 64模式下测试了 TI-JESD204c-IP、现在我们要将数据宽度更改为32位

以下是我们已经改变了

 

1.更改 JESD_LINK_PARAMS.Vh 中的通道数据宽度值  

`UNDEF RX_LANE_DATA_WIDTH
//`define RX_LANE_DATA_WIDTH 64
`define RX_LANE_DATA_WIDTH 32

`UNDEF TX_LANE_DATA_WIDTH
//`define TX_LANE_DATA_WIDTH 64
`define TX_LANE_DATA_WIDTH 32

2.将 SYS_PLL IP 的输出时钟从 122.88MHz 更改为245.76MHz

3、改变时钟频率和用户数据的宽度  

之后,我们试图生成 FPGA bitstrem ,但它停止了"write_bitstream error",如下图所示。   

使用32位通道数据宽度时是否错过了任何内容?


我们非常感谢对这个问题的任何评论。

提前感谢您。

-桑乔尔

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    尊敬的  Sangcheol

    我们将对此进行深入研究、下周我们会向您提供解答。

    此致、  

    卡米洛

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    您好,Camilo,


    感谢您的答复。
    我们在上一个问题中还没有说明另外两个事项。

    ……

    4.更改 ip_type

    我们已将"JESD_LINK_PARAMS.VH"中的 IP_TYPE 更改为
    请注意、我们将在定制设计中仅使用 AFE7903的 RX 接口。

    `define IP_TYPE "RxTxTx"
    `define IP_TYPE "RX"

    5.更改原来的"refdesign_rx.SV"

    为了支持32位数据通道、
    我们需要正确更改"refdesign_rx.SV"文件的某些部分。
    Vivado 中的综合和实施过程已经成功完成、
    因此、我们认为修改没有错误。

    我们期待您的回答。


    此致、


    -桑乔尔

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    尊敬的 Sangcheol:

    您能否确认在收发器向导的"Physical Resources"选项卡中选择了要在其上接收数据的八个通道?  

    在更改参考设计时、您是否对 TI_204C_ref 文件进行了任何更改?

    此致、

    大卫·查帕罗

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    尊敬的 David:  

    我们没有更改 TI_204C_ref 文件中的任何内容、收发器中的八个通道仍然亮起、如下图所示。

    此致、  

    -桑乔尔

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    尊敬的 Sangcheol:

    我认为可以测试两点。 第一种方法是将这些引脚分配给用于接收通道的同一个四通道。 另一个是从顶层文件中注释掉引脚 dac_lane、因为这些引脚未在仅 Rx 设计中使用。  

    此致、

    大卫·查帕罗