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  • RE: adc12j4000关于jesd204b链接问题

    你好，我目前使用ADC12J4000，也遇到同样的问题，V7 FPGA GTH接受不到K28.5，收到全是乱码，sync一直为低，但是205读回来的状态是18h。这个是什么原因，为什么收不到K28.5?谢谢

  • [参考译文] ADS54J66EVM：同步两个 ADS54J66EVM

    Other Parts Discussed in Thread: ADS54J66EVM , ADC12J4000 , ADS54J66 , LMK04828 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/794140/ads54j66evm-synchronize…
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  • RE: [参考译文] TSW14J56EVM：ACD12J4000 -更改 JESD204B K 值和 SYSREF 频率

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 你(们)好 K 值可以更改为16。 为了实现这一目标并使 ADC 和 FPGA 都正常工作、需要进行以下更改： ADC 寄存器设置-将 KM1 (K-1)值从3更改为15。 应编辑以下配置文件： ADC12J4000_DB1_DDR.cfg 该文件位于以下文件夹中： C：\Program Files (x86)\Texas Instruments\ADC12J4000EVM…
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  • RE: [参考译文] 输出

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好 Charles ADC12J4000只能在 DDC 旁路模式下输出12位数据。 请参阅数据表表表表11、其中显示 N (每样本位数)最小值为12。 如果您需要8位数据、则需要将12位数据接收到 FPGA 中、然后丢弃每个样本的低4位。 或者、您也可以使用 ADC08DJ3200等具有原生8位分辨率的器件。 此致、 Jim B
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  • [参考译文] ADC12J1600EVM：FT_DEVICE_NOT _ FOUND

    已解决
    Other Parts Discussed in Thread: ADC12J1600 , ADC12J4000 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/775232/adc12j1600evm-ft_device_not_found 器件型号： ADC12J1600EVM…
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  • RE: [参考译文] ADC12J1600EVM：ADc12J1600修订版 E3原理图

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 你好，Dmitri 可通过以下链接获取 ADC12J1600EVM 版本 E3原理图。 ADC12J4000修订版 E3和 ADC12J1600EVM 修订版 E3之间的唯一区别是 ADC 器件型号。 e2e.ti.com/.../ADC12J4000EVM-Schematic-Prints.-Rev-E3.PDF 此致、 Jim B
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  • [参考译文] ADC12J4000EVM：ADC12J4000的 JESD204B 输出数据

    已解决
    Other Parts Discussed in Thread: ADC12J4000EVM , ADC12J4000 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/753595/adc12j4000evm-jesd204b-output-data-of…
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  • RE: [参考译文] ADC12J4000EVM：正常模式下的 ADC12J4000EVM 问题

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好 Dmitri 在此问题上是否取得了任何进展？ 您可以在测试模式下使用 ADC 尝试另一项测试。 这个较旧的线程具有可使用 ADC12J4000 EVM GUI 低级视图选项卡加载的配置文件。 e2e.ti.com/.../2731337 一个将启用 ADC 测试图形模式、另一个文件将禁用该模式。 旧版文章还提供了一些有关调试格式的信息、这些信息可能会有所帮助。 此致…
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  • [参考译文] ADC12J4000EVM：无法在同一台计算机上同时打开配置和两个软件

    已解决
    Other Parts Discussed in Thread: ADC12J4000 , DAC38J82EVM , ADC12J4000EVM 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/758033/adc12j4000evm-configuration…
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  • RE: [参考译文] ADC12J4000EVM：ADC 和 LMK 配置

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 你好，Dmitri 关于您的最后一个问题、我们没有任何 Xilinx FPGA 对应的 ADC12J4000的特定固件示例、但有一个适用于 ADC12DJ3200的示例。 当 ADC12DJ3200在 JMODE 0中运行时、输出格式与 ADC12J4000的格式非常相似。 ADC12DJ3200固件示例位于页面的"软件"部分的此处： 我希望这对您有所帮助…

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