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RE: [参考译文] ADC32J25:ADC32J25:JESD204B 配置(第2部分)
admin
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请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 Andrew、您好! 我已下载您的最新文件、其中确实显示了 SYSREF 脉冲发生器。 是否需要设置另一个寄存器来启用 pulse sysref? 是的、我刚刚意识到您对 SYNC_MODE 寄存器设置不正确。 设置寄存器0x143 = 13。 这使您可以从同步 SPI 命令获取脉冲发生器信号。 我已在下面附加了这个.tcs 文件(很抱歉没有将我昨天使用的文件附加到该回复中…
6 个月前
数据转换器(参考译文帖)
数据转换器(参考译文帖)(Read Only)
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RE: [参考译文] ADC32J25:JESD204B 配置
admin
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请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 Andrew、您好! 要在切换同步后仅为 SYSREF 生成脉冲、您只需要设置寄存器0x139[1:0]= 0 (使 SYSREF_MUX =正常同步)。 希望这对您有所帮助! 此致! 安德烈亚
7 个月前
数据转换器(参考译文帖)
数据转换器(参考译文帖)(Read Only)
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RE: [参考译文] ADC32J25:Sync 和 Sysref 是否可以使用单端布线而不是差分布线
admin
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请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 尊敬的志刚: 数据表未引用任何用于驱动此单端运算的选项。 我们建议您以差分方式驱动 Sync 和 Sysref。 此致、Amy
8 个月前
数据转换器(参考译文帖)
数据转换器(参考译文帖)(Read Only)
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RE: [参考译文] ADC32J25:ADC JESD CAN';t link 与接收器 FPGA
admin
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请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 尊敬的春松: 该器件需要符合 JESD204B 标准。 这意味着要开始启动到 FPGA 的链路、首先必须发出 CGS (代码组同步)请求。 这是通过将 SYNC 信号置为有效(低电平有效)来启动的。 CGS 阶段完成后、器件将进入启动过程的 ILAS (初始通道对齐序列)阶段、FPGA 将 在 ILAS 完成时取消对 SYNC 信号的置位、从而向 ADC 指示 FPGA 已准备好接收实际的采样数据…
9 个月前
数据转换器(参考译文帖)
数据转换器(参考译文帖)(Read Only)
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RE: [参考译文] ADC32J25:与 FPGA 连接
admin
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请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 Andrew、您好! 因此对于正常的 ADC 操作,默认值全部为零。 这是否正确? 正确、ADC32J24的所有寄存器默认为0x00。 您能看一下格式是否可以使用吗? 查看您上传的最后一个配置文件、它应该能够在 如果您将第1行从"ADC32xx"更改为"ADC32Jxx"、并使用 ADC32Jxx GUI 页面。 否则、数据将无法读入…
10 个月前
数据转换器(参考译文帖)
数据转换器(参考译文帖)(Read Only)
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RE: [参考译文] LMK04828:无 SYSREF 输出
admin
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请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 Andrew、您好! 您能够获得 SYSREF 输出。 关于您的原理图、请查看以下备注: DCLKOUT2p/n (ADCCLKP/N):在幻灯片5上、我认为
ADC32J25
需要 LVDS。 那么、我应该按照幻灯片2中所述更新电阻器吗? SDCLKOUT3p/n (SYSREFP/N):此处存在相同的问题。 我是否应该更新电阻器? [/报价] 从 ADC 数据表中、以下是…
8 个月前
时钟和时序(参考译文帖)
时钟和时序(参考译文帖)(Read Only)
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RE: [参考译文] ADC32J25EVM:TSW14J50EVM 设置存在噪声问题
admin
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请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 Archie、 请按照随附文档中的步骤操作。 我们不会看到您报告的问题。 在配置电路板之前、务必发出 ADC 复位命令。 此致、 吉姆 e2e.ti.com/.../
ADC32J25
.pptx
12 个月前
数据转换器(参考译文帖)
数据转换器(参考译文帖)(Read Only)
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RE: [参考译文] ADC32J25:原理图审阅请求和时钟速率
admin
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请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 谢谢 Jim
1 年多前
数据转换器(参考译文帖)
数据转换器(参考译文帖)(Read Only)
RE: ADC32J25: ADC32J25的时钟电平问题
Kailyn Chen
jianyong luo 说: 补充以上问题,
ADC32J25
规格书上如下的描述,所说的采样时钟是否就是我们输入ADC的时钟呢? 输入clock前端有个分频器,经过分频器的时钟即为采样时钟。 分频是通过寄存器27h bit[7:6]设置的。比如CLKIN 时钟为160Mhz,默认divider为1的话,那么采样时钟就是160Mbps。 可以看到,采样时钟范围为25Mbps~160Mbps,如果采样时钟为160Mbps,divider 配置为4的话,那么输入时钟需要640Mhz的频率。
1 年多前
数据转换器
数据转换器论坛
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RE: [参考译文] LMH6551:原理图审阅请求
admin
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请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 感谢 Andrew、这是一个重大进步、让我有机会定期完成我以前做过的一些事情、 我想我在 Intersil 开发这一流程的同时,发表了一系列关于这一流程的背景文章-如果你想详细地埋葬,我可以寻找这些文章,其中很多都是在这一过程中积累的(并且充分发挥作用) ADC + FDA +滤波器演示板、这个演示板面向平衡-输出材料是我在这里向您展示的内容的前身、涉及许多其他很酷的东西、我认为这仍然是通过100Mhz…
1 年多前
放大器(参考译文帖)
放大器(参考译文帖)(Read Only)
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