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  • ADC3663: 上电后一定需要硬件复位才能使用吗？！

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    Part Number: ADC3663 如上图所示，ADC3663数据手册中提到了，上电后必须给reset引脚一个高脉冲，让它恢复默认的参数设置。 因为我们现在的FPGA没有多余引脚了，原理图设计时候，只是把reset简单的用2K电阻上拉到1V8（其实它里面也有个21K上拉电阻），没有额外的控制。 这样的话，ADC3663，可以正常使用吗？！
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  • [参考译文] ADC3663：测试模式寄存器

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1176336/adc3663-test-pattern-register 器件型号： ADC3663 您好！ 根据表8-22、需要为 16位 ADC 设置斜坡模式。如何设置 REG0X14/15/16？ …
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  • ADC3663: 输入信号类型

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    Part Number: ADC3663 ADC3663是差分输入，我的测试需求是这样的，可以使用吗 1. 电源的电压信号，比如在1V附近不规则变化. 那可以INP端接电源，INM接地吗 2. 测电阻两段电压，信号在5mV~100mV不规则波动, 可以测吗？
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  • [参考译文] ADC3663：FS 输入电压

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1130573/adc3663-fs-input-voltage 器件型号： ADC3663 您好、专家、 谨澄清： 在满量程时为3.2Vpp 差分时、最大正摆幅只能为1.6Vpp 差分。 因此、当 AINP…
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  • [参考译文] ADC3663：采样时钟(CLK)的时钟输入、Dclkin

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    Other Parts Discussed in Thread: ADC3663 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1173059/adc3663-clock-inputs-for-sample-clock-clk-dclkin 器件型号：…
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  • [参考译文] ADC3663：SLVDS 和 LVDS

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    Other Parts Discussed in Thread: ADC3663 , DS25BR101 , DS25BR150 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1111933/adc3663-slvds-and-lvds 器件型号： ADC3…
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  • [参考译文] ADC3663：DDC 旁路中的 FCLK 错误

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    Other Parts Discussed in Thread: ADC3663 , ADC3663EVM 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1129151/adc3663-fclk-error-in-ddc-bypass 器件型号： ADC3…
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  • [参考译文] ADC3663：关于串行 LVDS 接口

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1109479/adc3663-about-serial-lvds-interface 器件型号： ADC3663 大家好、 1) 1) SLVDS (串行 LVDS)和 LVDS 是否不同标准？ 2) 2…
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  • [参考译文] ADC3663：在 ADC 输入端交换 P 和 N 的影响

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  • ADC3663: 50M 采样率下 DDC 在Bypass时输出的时钟FCLK占空比不为50%

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    Part Number: ADC3663 将ADC3663进行50MHz采样，设置如下：2wire、16bits、同时DDC设置为bypass；CLK输入时钟为50MHz、DCLK输入时钟为200MHz，最终测试出的AD输出的FCLK时钟不是25MHz且其占空不为50%的时钟信号，后进行其他采样率测试只要DDC使用bypass，发现AD的FCLK输出均不为占空比50%的时钟信号，而在DDC的抽取率设置为2或其他均正常，请问什么寄存器设置错误可能造成该现象？

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