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  • RE: [参考译文] 适用于照片敏感型应用的超低噪声电源链

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 Shyam、您好！ 我们为您提供各种选择。 TPS7A88性能出色、但我们可以做得更好。 请查看您尝试滤除的开关频率、并评估这些曲线中的 PSRR 是否可行、或者您的系统中是否需要更多 PSRR。 如果您有任何问题、请告诉我。 正极 LDO - TPS7A94 TPS7A94是业内噪声超低的 LDO、它是一个正电源轨输出、可提供1A 的电流。 它可提供从10Hz 到100KHz…
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  • RE: [参考译文] ADS1263EVM-PDK：测量浮动传感器时出现负 PGA 轨问题

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 Olivier、您好！ 查看此处的 ADS1262和 ADS1263 Excel 计算器工具、以检查您的输入信号是否在 PGA 的共模范围内： http://www.ti.com/tool/ads126x-calc-tool 如果您有双极电源(+/-5V)、您是否分别为 AVDD 和 AVSS 提供+2.5V 和-2.5V 电源？ 如果 AVSS 为0V，则您的输入电压将需要拍出至少…
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  • [参考译文] TMS320C6657：DDR3调平失败，状态= 0x40000064

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/processors-group/processors/f/processors-forum/847635/tms320c6657-ddr3-leveling-has-failed-status-0x40000064 器件型号： TMS320C6657 您好、香榭丽舍 客户设计了自己的 C6657电路板、但在 DDR3调平测试中失败…

  • 关于6678开发板的DDR初始化问题

    Hi，all！ 试着用DDR3配置参数的Excel（DDR3 PHY Calc v10）来验证STK代码中的DDR3初始化配置。 发现： 1.原理图中6678控制器的DDRCLKOUTP0时钟信号，外接了电阻和电容，但是在PCB上，并未看到有这两个阻容。 2.在DDR3 Initialization文档中，提到6678 EVM的DDR3配置值，这些值即是DDR3 PHY Calc v10 Excel的初始化值。 但是，实际去测量了下6678EVM PCB，发现 DQS的inch能对上，但是CK的inch却对不上…

  • RE: [参考译文] LM5175：LM5175降压/升压转换器：WEBENCH 设计的输出电容不足以稳定 PSU。

    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好、Jim、 如果 MOSFET 处于吸烟状态、则很可能会损坏。 如果开关节点的振铃高于30V、则可能会因过压而损坏。 WEBENCH 提供的输出电容似乎位于低端 我还建议添加一些电解电容器来提供一些大容量电容。 要双击电路板上组件的补偿环路、请使用下面的 Excel 快速入门计算器。 www.ti.com/.../lm5175quickstart-calc 快速看一下原理图…

  • RE: [参考译文] LM25145：可实现更高输出电流的并联稳压器

    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 Hoa、 一个每相电流为20A 的两相解决方案是可行的。 请考虑 LM25119或 LM5140-Q1电流模式控制器。 也可以使用 LM25145电压模式控制 器、您可以查看以下内容：e2e.ti.com/.../how-to-design-a-simple-two-phase-current-sharing-synchronous-buck-regulator-using…
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  • RE: [参考译文] ADS1263：数据速率未设置(38.4kSPS 数据速率显示为约5kSPS)

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 Ashish、您好！ 好的-感谢您的寄存器设置！ 我现在看到了问题... 在对 MODE0寄存器进行编程时启用输入斩波模式。 启用斩波时、ADS1262将获取2个转换结果(交换输入极性)、然后将这些结果平均在一起。 斩波时、数字滤波器在每次新转换时都是一流的。 如果您关闭斩波、您将以预期的38.4kSPS 数据速率输出数据。 有关 不同模式下的数据速率计算、请参阅…
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  • RE: [参考译文] 编译器/ADS1261EVM：数据采集(代码)转换为电压不匹配(可能存在输入阻抗问题)

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好 Freddy、 ADS1261输入为高阻抗(PGA 启用时为~1千欧、PGA 旁路时为~50兆欧)、因此在使用需要50欧姆负载的信号发生器时、您可能会看到预期振幅加倍。 这些输入必须为高阻抗、这样、当处理具有较大输出阻抗的信号时、ADS1261就不会加载信号源。 您可以在 ADC 输入端添加一个50欧姆分流电阻器、以使输入阻抗在信号源中看起来是50欧姆负载、但我不明白为什么需要这样做…
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  • RE: [参考译文] TPA3245EVM：TPA3245EVM频率响应

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 Josh， 我目前不确定您看到这个的原因，但让我来了解一下。 您是否使用过我们的D类LC过滤器设计器Excel工具？ 以下是一个链接： www.ti.com/.../lcfilter-calc-tool 它允许您使用上面附加的相同图绘制和实验。 这种工具是理想的，但我怀疑你应该看到你是什么。 此致， -Adam
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  • RE: [参考译文] TMS320C6655：由于 DDR 配置而导致的不稳定

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好、Tom、 附加 Excel 工作表、并将所有请求的信息合并在一起。 这适用于当前设置： DDR3 SDRAM 的设置：CK=666.67MHz； TCK=1/CK=1.500ns ； tRCD =TRP=CL=13.75ns ；速度-125 (1.25ns 或800MHz)。 实际上、客户只需要知道如何最好地计算 CL/CWL/AL/RL/WL 延迟、因为在我们看来、这似乎是独立的选择…

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