Other Parts Discussed in Thread: ADS54J54ADS54J54片内4个通道，通道AB同步精度在几十ps内，通道CD同步精度在几十ps内，但是通道BC的同步精度很差，而且是随机的。目前使用的工作模式是通道CD采用AB的时钟，也使用的AB的SYSREF，FPGA端使用8个lane接收数据，请帮助分析解决问题，谢谢！！！
Other Parts Discussed in Thread: ADS54J54 我最近在使用ADS54J54芯片，4个通道，FPGA端使用一个JESD IP核接收数据，发现AB通道间同步以及CD通道间同步没问题，但是BC通道间的同步是随机的；
FPGA端使用两个JESD IP分别接收AB通道、CD通道数据的时候，发现两个IP核的SYNC是同时变高的，但是两个IP核产生的rx_tvalid能相差5~6us（采样率393M），请问这是什么原因以及ADS54J54芯片4个通道的同步应如何设计？谢谢！…
Other Parts Discussed in Thread: ADS54J60 , ADS54J69 , ADS54J54 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/654566/tsw1400evm-adc-s-available-for-the…
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Other Parts Discussed in Thread: ADS54J54 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/631712/ads54j54-how-to-configure-for-unused-sysrefcdp-m-pins …
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