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  • [参考译文] ADS4249：完善 ADC 建议

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    Other Parts Discussed in Thread: ADS4249 , ADS54J60 , ADC12DJ3200 , ADC16DX370 , ADC12D1800 , ADS42LB69 , ADS62P49 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters…
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  • [参考译文] ADS4249EVM：TI推荐的TCXO和滤波器已过时。

    已解决
    Other Parts Discussed in Thread: ADS4249EVM , ADS4249 , ADS62P49 , ADS42JB69EVM , ADS42B49 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/658298/ads4249evm…
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  • [参考译文] CDCE72010：将多个非板载 CDCE7210 PLL#39与 eachother 同步

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    Other Parts Discussed in Thread: CDCE72010 , LMK04832 , ADS62P49 , DAC3283 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/841724/cdce72010-synchronizing-multiple…
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  • RE: [参考译文] ADS41B29：ADS41B29

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 你好、Nima、 根据芯片设计人员、不可能将瞬态模型完全收敛到静态模型中。 这是学术和行业中已知的限制。 由于 ADC 本身是具有奈奎斯特属性的采样器件、因此这些模型是近似的。 它不是所有晶体管在没有开关的情况下偏置的传统运算放大器电路(即时钟) 您可能会看到以下模型作为示例： https://www.ti.com/product/ADS62P49#design-tools…
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  • RE: [参考译文] DAC3283：DAC 配置寄存器#39；设置问题

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 尊敬的 Eric： 您需要联系 Abaco、以获得对不同设置模式的额外支持、以及与基于 Xilinx 的 FPGA 的协支持包。 我(TI)不熟悉基于 Xilinx 的 FPGA 支持包应该如何在不同模式下工作 有几个基本问题： DATACLK 应该来自 FPGA、因为 DATACLK 应该是源同步的并且与 DDR 数据对齐。 DAC3283在数据总线技术规格中的 DAC3283数据表下有特定的建立…

  • CDCE72010输出时钟问题

    Other Parts Discussed in Thread: DAC3283 , ADS62P49 几个通道配置一样，输出波形差异很大 时钟的占空比不对，影响了我系统的工作，怎么调整呢
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  • RE: dac3283输出波形老是不正确

    已解决
    ADS62P49在高速下，你可以调整一下44寄存器的值。

  • 求ads62p49EVM使用指南

    我去年买了一批ADS62P49EVM评估板，想搭配xilinx的KC705开发板使用来着。今年开始用的时候发现在TI的官网上都找不到这款评估板的使用指南，到底是怎么回事呢，是不是因为这款评估板停产了所以使用指南也没了？ 没有使用指南，我都不知道这个评估板上的一些跳线啊，芯片啊怎么设置…… 能够请TI的工程师给我发一份这个板子的数据手册过来，万分感谢！！！

  • RE: ADS62P42IRGCT空采偏置的问题

    人呢，能解答不？

  • 使用ADC ads62PXX (i.e. ads62p48)怎么保证数字输出在上电后处于高阻状态？

    Other Parts Discussed in Thread: ADS62P48 亲们好！ 简单地讲，我的问题是，当ADC的reset脚接另一个芯片的控制脚（而非硬接地，而该控制芯片与ADC同时加电，上电之后才给出LOW去控制RESET）的条件下，并行控制脚ctrl1/ctrl2/ctrl3在硬接成100时，加电后，ADC是否可以处于Global power down状态？ 具体地讲，我的设计中，ADC ADS62P48的控制脚trl1/ctrl2/ctrl3硬接成100，而其它控制脚如SEN,Reset…

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