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• RE: [参考译文] BOOSTXL-ADS7841-Q1：获取准确的 ADC 值时会出现问题

  

  admin

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  请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 尊敬的 Vaibhav： 尝试更改 SPI 的相位- ADS7841希望看到 CPOL=0和 CPHA = 0 (数据在 SCLK 上升沿有效的低住户 SCLK)。

  • 7 个月前
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• RE: [参考译文] ADS7841-Q1：ADS7841-Q1

  

  admin

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  请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 尊敬的 Chandrashekhar： 欢迎来到我们的 e2e 论坛！ ADS7841只有一个电源引脚、因此确实没有特定的上电/断电顺序。 话虽如此、请查看数据表第3页的绝对最大额定值表。 模拟和数字输入不应超过(或低于)电源300mV (请参阅注释(1))。

  • 12 个月前
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• RE: ADS7841: 部分器件出现单端采样正常（ch0、ch1采样正常），差分采样会只能采一个方向的电压（ch0<ch1时可以采样），另外方向无法采样（ch0>ch1时无法采样）

  

  Amy Luo

  注意转换器正输入端和负输入端输入电压范围是不一样的，见我上面第一个截图， 切换采样方向后输入范围是否还满足ADC规格范围？

  • 1 年多前
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• ADS7841: 如何配置DCLK

  

  LanQing Luo

  TI 认为已经解决

  Part Number: ADS7841 这是我第一次接触AD芯片 我想使用FPGA驱动ADS7841芯片，我想要的采样频率是200ks/s，请问我我在DCKL输入的频率是多少才合适呢？ 此外，如果有相关的FPGA驱动AD芯片的教程或者参考资料，有人愿意分享一下吗？

  • 1 年多前
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• RE: [参考译文] ADS7841：ADS7841E

  

  admin

  请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 Hai Cynthia、 我可以向我发送将 tms320f28379d 与 ads7841连接的步骤、因为 我在尝试我的一侧的所有组合后无法获得输出。

  • 3 年多前
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• RE: [参考译文] BOOSTXL-ADS7841-Q1：输出高于 Vref

  

  admin

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  请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好、Art、 当输入处于或超过 VREF 时、器件应继续输出满量程代码值。 一旦超过输入的绝对输入范围(Vcc+0.2V)、运行状态应该保持在满量程、但是不在建议的运行条件内、并且在所有运行条件下有可能是不可预知的。 如果超过绝对最大额定电压、器件可能会永久损坏。

  • 4 年多前
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• ADS7841驱动资料分享

  

  xyz549040622

  Other Parts Discussed in Thread: ADS7841 ADS7841驱动-51单片机 ADS7841驱动-C51.doc

  • 4 年多前
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• RE: [参考译文] Linux/ADS7841：ADS7841

  

  admin

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  请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好！ 我现在很清楚。 我们可以将该线程视为已关闭。 感谢您的宝贵响应和支持。 祝你一切顺利。

  • 5 年多前
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• RE: [参考译文] ADS7841-Q1：BUSY 引脚功能

  

  admin

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  请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 你好 BUSY 信号是器件的一个输出、当转换正在进行时通知用户、一旦转换完成、BUSY 信号就不再处于活动状态。 为了实现正确的 SPI 通信或转换结果、不需要监视 BUSY。 可以在不忙的情况下完成。 您可以将其保持浮动。 BUSY 是监控器件是否处于活动状态、是否正常工作以及何时进行转换的理想方式。 希望这对您有所帮助 Cynthia

  • 5 年多前
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• RE: [参考译文] BOOSTXL-ADS7841-Q1：无法从 TM4C1294XL 获取 ADS7841-Q1的数据输出

  

  admin

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  请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 Tran、您好！ 到目前为止、示波器画面看起来不错。 处理器和转换器之间的每个通信都包含八个时钟周期。 但是 、一个完整的转换 通过三个串行通信来完成、在 DCLK 输入上总共有24个时钟周期。 请注意、在发送控制位后的第二组8个时钟周期之前、您将不会看到 SDO 变化、所有这些情况下 CS 都保持低电平。 如果您继续提供时钟周期、您应该会看到 SDO。 此外、通过了解您如何 …

  • 5 年多前
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