Part Number: CDCE62005 采用AUX_IN输入25MHz时钟，外部配置引脚如图均设为高电平（经测量确为高电平），芯片寄存器为默认，希望能实现芯片手册示例中的输出（156.25MHz和125MHz等输出）。
经测量芯片供电正常，输入时钟正确给入，但都无输出，且PLL_LOCK始终为低电平。求问可能是出了什么问题？
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