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找到 356 个结果 查看 问题 帖子 排序依据
    Answered
  • [参考译文] TIDA-00078:CDCE62005 GUI 控制

    admin
    admin
    已解决
    Other Parts Discussed in Thread: CDCE62005 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/tools/simulation-hardware-system-design-tools-group/sim-hw-system-design/f/simulation-hardware-system-design-tools-forum/675054…
    • 已回答
    • 8 年多前
    • 仿真、硬件和系统设计工具(参考译文帖)
    • 仿真、硬件和系统设计工具(参考译文帖)(Read Only)
  • 关于CDCE62005配置相关问题!

    q zhao
    q zhao
    Other Parts Discussed in Thread: CDCE62005 自己设计的6678原理图,FPGA+DSP6678,FPGA控制6678上电,DSP时钟由2级CDCE62005提供,第一级由外接参考时钟25M晶体提供;第二级由第一级产生100M做参考,大体原理是参考开发板设计,相关电路也是采用开发板设计,PD是一上电就拉高。通过软件工具和手册配置了两级62005寄存器输出100M,现象是所有输出均没有,PLL_LOCK长低;经测量电源均正常; 1 晶体没有起振,晶体是一端接地…
    • 8 年多前
    • 处理器
    • 处理器论坛
  • cdce62005 配置问题

    user1359349
    user1359349
    Other Parts Discussed in Thread: CDCE62005 我们在做一个设计,用到cdce62005,输出时钟是155.52,输出也是155.52,用cdce来做时钟clean,我在配置cdce62005的时候,想把环路带宽设置成100hz,但是ratio pole T3 to T1这个选项设置总是出问题,一直显示是 1, 请帮忙看看是什么问题,谢谢
    • 9 年多前
    • 接口
    • 接口论坛
  • Answered
  • RE: [参考译文] CDCE62005:芯片#39;s 输出时钟= 2.5 x [所需频率];锁定未激活。

    admin
    admin
    已解决
    请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 尊敬的 David: 您是在 CDCE62005 EVM 上还是在另一个自己的电路板上进行测量? 使用 CDCE62005 EVM 和配套 GUI、我能够顺利地将您的配置编程到器件中。 首先、我将配置保存到*。ini 文件中、然后将配置文件加载到 GUI 中、写入所有寄存器、然后校准器件。 在默认设置3.4ns 下校准后、PLL 锁定指示器始终为高电平。 我正在测量输出端的正确输出频率…
    • 7 年多前
    • 时钟和时序(参考译文帖)
    • 时钟和时序(参考译文帖)(Read Only)
  • Answered
  • RE: [参考译文] LMK04828BEVM:LMK04828BEVM DCLK0输出电平、用于驱动 J9上的 DAC3484EVM CLKIN (即 CDCE62005外部时钟输入)

    admin
    admin
    已解决
    请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 尊敬的 Ron: 首先,让我们检查 DAC348XEVM 上 CDCE62005的跳线。 JP4、分流器2-3 JP5、分流器1-2 JP6、分流器1-2 这应使 PRIREF 有效、CDCE62005通电、并使 PRIREF 输入端接直流偏置+ 50 Ω。 由于输入了153.6M、并且需要 CDCE62005中的491.52M、我使用 EVM 软件配置了 CDCE62005…
    • 7 年多前
    • 时钟和时序(参考译文帖)
    • 时钟和时序(参考译文帖)(Read Only)
  • Answered
  • RE: CDCE62005 输出时钟问题

    jfq
    jfq
    已解决
    上面的参考频率输入的是 AUX 晶体的频率吗? 各路输出信号,频率高的幅值非常低,是不是示波器测量不准,还是阻抗不匹配?我采用的是交流耦合方式,电容为0.1uF,接收端c6655 各路时钟,没有并100欧电阻。 另外,CDCE62005输出的信号是正弦波还是方波?
    • 9 年多前
    • 接口
    • 接口论坛
  • 求助:cdce62005失锁

    xu chen
    xu chen
    Other Parts Discussed in Thread: CDCE62005 大家好: 最近新焊接了一批6678的板卡,发现JTAG无法连接,后来发现是时钟没有锁住,前几次上电还可以锁住,之后再上电就无法锁住,lock信号波形是600KHz左右的脉冲。 时钟部分参考的EVM板,使用的是cdce62005,100MHz输入,输出156.25MHz、100MHz和62.5MHz。SPI读写时序是用FPGA做的,一样的时序,一样的配置文件,在老批次板卡里是好的。 后来检查配置文件…
    • 9 年多前
    • 接口
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  • 有关CDCE62005的初始化 TI工程师看过来

    skysteed
    skysteed
    Other Parts Discussed in Thread: CDCE62005 大家好 我仿照CDCE62005评估板做了一块一样的板子 想实现对我自己板子上62005的初始化 CDCE62005 1.4.8.exe也安装了 但是电脑认不到设备 我的系统是WIN7 64位 有个疑问 这样是否可行 能否实现对自己板子上62005的初始化 我看到 62005的评估板上外接了24LC512 这是一个串行的EEPROM 里面是不是有程序之类的??? 电脑认不到设备 是不是和这有关??? 请TI工程师解答下…
    • 9 年多前
    • 处理器
    • 处理器论坛
  • Answered
  • [参考译文] CDCE62005:未通电时、向 TI 时钟发生器应用时钟是否安全?

    admin
    admin
    已解决
    请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/673248/cdce62005-will-it-safe-to-apply-clock-to-ti-clock-generator-when-it-is-not-powered 器件型号: CDCE62005 您好…
    • 已回答
    • 8 年多前
    • 时钟和时序(参考译文帖)
    • 时钟和时序(参考译文帖)(Read Only)
  • CDCE62005的输入晶振不起振

    Xuhua Du
    Xuhua Du
    Other Parts Discussed in Thread: CDCE62005 电路设计是按照TMS320C6678EVM开发板画的。两脚晶振,旁边加个起振电容。在此不贴出来了。 当把程序下载到FPGA后,晶振的输出端一直是高电平,测了电压是2.16V,电压在波形和地的抖动一样,所以判断没有起振。 但是比较奇怪的是晶振没起振,但是CDCE62005的输出都有,在低频输出的情况下波形较好,但是在高频输出的情况下,比如100M的情况下,波形很烂,像是和地一样,只不过是拉高的。输出频率为312.5M的时候…
    • 9 年多前
    • 接口
    • 接口论坛
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