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  • RE: [参考译文] CDCM7005-SP：设置灵敏度(5962-0723001VXC)72.3001万)

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好Andres： 我们的团队 将通过电子邮件与您联系，了解您的进一步需求。 请留意我们的电子邮件。 谢谢！ Vibhu
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  • [参考译文] CDCM7005-SP：Vik LVCMOS 输入钳位电压

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1085348/cdcm7005-sp-vik-lvcmos-input-clamp-voltage 部件号： CDCM7005-SP 您好， 我发现 PRI_REF 是 LVCMOS 输入，LVCMOS 规格显示的…
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  • [参考译文] CDCM7005：需要 REFCLK

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    Other Parts Discussed in Thread: CDCLVP111 , CDCM7005 , CDCM7005-SP 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1083865/cdcm7005-need-for-refclk 部件号： CDCM7…
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  • RE: [参考译文] CDCM7005：初级放大器；次级时钟要求

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 你好 Satish、 因此、您使用的是 XO 而不是 VCXO、这意味着您询问是否可以将 CDCM7005用作缓冲器。 是的、这是可能的。 这基本上是器件的保持类型函数。 不过、您可能会考虑其他一些缓冲器 IC、如 LMK00306。 我还将指出、我们有一个 IC、例如 LMK04906或 LMK04610、它可以灵活地用作时钟源或缓冲器。 LMK04906可与外部 VCXO…
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  • [参考译文] DS26F31MCML-SP：虚拟包？

    已解决
    Other Parts Discussed in Thread: DAC121S101QML-SP , LF411QML-SP , LM111QML-SP , LM119QML-SP , LM158QML-SP , LM4050QML-SP , LM7171QML-SP , LMH6628QML-SP , LMH6702QML-SP , LMP2012QML-SP , DS16F95QML-SP , LM124AQML-SP , LM139AQML-SP , ADC128S102QML-SP , DS90C031QML-S…
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  • [参考译文] DS16F95QML-SP：虚拟套件？

    已解决
    Other Parts Discussed in Thread: DS16F95QML-SP , DAC121S101QML-SP , LF411QML-SP , LM111QML-SP , LM119QML-SP , LM158QML-SP , LM4050QML-SP , LM7171QML-SP , LMH6628QML-SP , LMH6702QML-SP , LMP2012QML-SP , LM124AQML-SP , LM139AQML-SP , ADC128S102QML-SP , DS90C031QML-S…

  • CDCM7005: PLLVCO状态指示异常

    Part Number: CDCM7005 原理图接法： VCO 指标： 输出频率： 384MHz 输出功率： 1.5~4.5dBm 调谐电压 0.5~2.5V 压控灵敏度： 3-6MHz/V PLL 设置： 输出时钟： 384MHz ， 96MHz ， 24MHz 参考时钟： 100MHz 问题：六块板卡有两块的板卡的 CDCM7005 芯片， STATUS_VCO 状态指示管脚，在低温 -10 度时， STATUS_VCO 状态指示异常，锁定指示也异常，但测试芯片的输出时钟 384MHz ， 96MHz ， 24MHz 无问题，证明锁相环锁定正常…

  • RE: [参考译文] CDCM7005-SP：启动后进行 SPI 编程

    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好、Camilo、 我想阻止我们编程的唯一方法是 LE 引脚仍 被拉高。 您能否检查 SPI 波形以进行确认？

  • How to design a PLL clock circuit that can receive a WordClock input and output BCLK

    TI 认为已经解决
    Other Parts Discussed in Thread: SRC4192EVM , LMK61E2 , SRC4192 , CDCM7005 I am designing an audio circuit, the circuit needs to synchronize the external clock, the clock is a professional audio commonly used WordClock (sampling rate is typically 44.1kHz…

  • RE: [参考译文] CDCM7005-SP：STATUS_VCXO 和 PLL_LOCK 异常

    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好、Amy、 您知道吗、它们的设置中使用了什么相位检测器频率/反馈频率？ 数据表建议反馈频率应大于2MHz、以获得正确的 STATUS_VCXO 信号。 否则、频率检测电路会将 STATUS_VCXO 信号和 PLL_LOCK 信号复位为低电平。 如果他们仍然看到问题、 建议共享使用过的配置文件以查看问题。 此致、 Ajeet Pal

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