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  • RE: [参考译文] DAC3482：PLL 锁定问题

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好、Wayne、 ALARM_FORT_PLL 是一款模拟 PFD 检测器、用于检测 PFD 的上升/下降电流之间的电流漂移、以确定 PLL 锁定。 应该有一些标准教科书来讨论实现和潜在的泄漏电流影响精度 DAC348x 系列硅质铁在这种特定的锁定检测器方面存在一些问题、我们决定不向客户推荐这种方法。 版本 ID 从0x7F 寄存器读回。 基本上、硅酮的生产版本和早期测试版本存在这一问题…

  • 6/13日更新【资料共享】TI 信号链技术热门资料汇总

    Other Parts Discussed in Thread: PGA308 , ADS1198 , DAC3484 , DAC34H84 , AFE0064 , ADS8363 , TMS320F28335 , ADS8555 , ADS8365 , TMS320F2812 , TMP125 , SN75DP129 - 《信号链基础知识合集》下载： https://www.deyisupport.com/question_answer/f/60/p/258/437.aspx#437 放大器 - 放…
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  • [参考译文] DAC34H84：DAC34H84

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    Other Parts Discussed in Thread: DAC34H84 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/689961/dac34h84-dac34h84 器件型号： DAC34H84 主题中讨论的其他器件： DAC3484EVM …
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  • RE: [参考译文] DAC3482：加电后的本底噪声和杂散异常

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好 Jerry、 配置0x24 (或 CONFIG36寄存器)用于调整 LVDS 总线的设置/保持时间。 可以通过内部 LVDS 数据或数据通信延迟来调整设置/保持时间、以匹配外部时序。 每个延迟所需的最小设置/保持时间根据 CONFIG36设置进行移位。 客户将需要测量每个与 DATACLK 相关的 LVDS 引脚、以确保满足良好的设置/保持时间。 否则、将出现位错误 …
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  • RE: [参考译文] DAC34H84：dac34h84的控制信号？

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 Amit、您好！ 1. TI 不建议使用 FIFO 旁路模式。 原因是、在 FIFO 被旁路时、您必须确保 DATACLK 和 DACCLK 完全同步、而不会随着时间的推移而产生延迟。 请参阅下面的应用手册、了解使用 FIFO 的原因 由于 DATACLK 和 DACCLK 速率匹配、因此使用1x 内插滤波器是可能的。 FPGA 时钟具有高抖动量、会显著降低 DAC 性能…

  • DAC34H84 HD2性能优化与PCB布局建议

    Other Parts Discussed in Thread: DAC34H84 以前写的APP NOTES。主要针对高速DAC：DAC34H84的性能优化。
    • DAC34H84 HD2性能优化与PCB布局建议.pdf

  • TI的通信发射解决方案

    附件里是TI在通信领域主推的发射方案。主要包括时钟，DAC，调制器等。 希望对大家有帮助
    • TSW308X EVM.pdf

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