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  • [参考译文] DAC5681Z：如何增加输出增益。

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    Other Parts Discussed in Thread: DAC5681Z 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1502994/dac5681z-how-to-increase-output-gain 器件型号： DAC5681Z 工具…
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  • [参考译文] DAC5681Z：单端支持

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    Other Parts Discussed in Thread: DAC5681Z 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1470477/dac5681z-single-ended-support 器件型号： DAC5681Z 工具与软件： 我想在单端模式下使用…
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  • [参考译文] DAC5681Z：电路板启动

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    Other Parts Discussed in Thread: DAC5681Z , DAC5682Z , DAC5681ZEVM , DAC3152 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1250130/dac5681z-board-bring…
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  • [参考译文] DAC5682Z：DAC5682z 和 DAC5681z 引脚是否兼容？

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    Other Parts Discussed in Thread: DAC5681Z , DAC5682Z 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1237898/dac5682z-dac5682z-and-dac5681z-pin-compati…

  • [参考译文] DAC5681Z：频率输出错误

    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1179547/dac5681z-wrong-frequency-output 器件型号： DAC5681Z 我从另一个项目继承了一些代码。 它旨在以 60MHz 频率从 FPGA 存储器输出波形。 我知道存储器内容是使用开发板针对该…
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  • [参考译文] DAC5681Z：数据采样率与插值间的关系

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/927337/dac5681z-data-sampling-rate-vs-interpolation 器件型号： DAC5681Z 您好！ 我们无法理解 FPGA 的输入数据速率(输入时钟250MHz…
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  • RE: [参考译文] DAC5681Z：使用DAC的基础(DAC5681Z)

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 感谢您的回答。

  • RE: DAC5681Z芯片 CONFIG10中低三位DLL_ifixed(2:0)取值

    嗯嗯，谢谢了 想问下TSKEW(A)、TSKEW(B)和建立时间、保持时间有什么区别呢

  • RE: DAC5681z输入16bit数据和数据随路时钟DCLKP/N

    您好，不太理解LVDS的clock是怎么进行数据锁存和恢复的，有参考资料吗？谢谢了

  • DAC5681z输入16bit数据与随路时钟DCLKP/N同源的判断

    Other Parts Discussed in Thread: DAC5681Z 想请教下关于DAC5681Z的使用问题，具体如下： 利用两个OSERDES原语模块（时钟相同）分别产生随路时钟DCLK和16bit数据，想问下这样有什么问题吗？会不会不满足DAC芯片的建立时间要求呢？ 以及当DCLKP/N=96MHz，输入数据和随路时钟满足的建立时间手册中没有给出，如下图所示：

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