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  • [参考译文] DAC34SH84EVM：将 DAC34SH84EVM 连接到 FMC-DAC 适配器(Xilinx)时、机械连接器之间不匹配

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/757095/dac34sh84evm-mismatch-between-mechanical-connectors-when-interfacing-dac34sh84evm-to-fmc-dac-adapter…

  • RE: [参考译文] ADS54J64EVM：评估模式6

    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 Daniel： 模式6将起作用。 只需将地址0xAD 和0xAE 设置为0x06。 在 JP3设置为 FMC 模式时、CPLD 将使用来自 FMC 连接器的以下信号来控制 ADC 和 LMK SPI： FMC_SCLK、FMC_SDIO、FMC_SDO、FMC_SEN_ADC 和 FMC_SEN_LMK。 如果您要在3线制 SPI 模式下使用 ADC 或 LMK、则 CPLD…
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  • [参考译文] AFE7900EVM：请求获取有关将 ADC 输出 ILA 数据正确放置到 HSDC Pro 的指南

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    Other Parts Discussed in Thread: AFE7900EVM 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/rf-microwave-group/rf-microwave/f/rf-microwave-forum/1296151/afe7900evm-request-to-guide-on-ploting-adc-output-ila-data-on…
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  • RE: [参考译文] ADS54J40EVM：自动配置

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 雅龙 如果您可以访问 FMC 引脚 C30、C31、C34和 D35、则可以移除 U14和 U6、并将 TP13-TP16的导线连接到 U6的焊盘。 这将为 FMC 和 ADC 之间的四条 SPI 线路提供连接。 如果这些 FMC 引脚不可用、则必须连接到您计划使用的任何引脚、以使用测试点创建 SPI 信号、 测试点连接到移除的 U6的焊盘上。不过、您仍需要使用 LMK 的 GUI…
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  • RE: [参考译文] AFE7900EVM：选择用于实现 ZCU102和 AFE7900/LMK 之间 SPI 通信的 FPGA 引脚时所需的帮助

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 尊敬的 Bala： 我认为参考设计限制条件文件中所使用的时钟和信号存在混淆。 约束文件中的 sys_clk_p 是 JESD 内核时钟、该时钟用于从 ADC 通道数据中获取样本并将样本组合到 DAC 的通道数据中。 该时钟应由 AFE EVM 上的 LMK 提供。 SYSREF 也必须来自相同的时钟源、因此它也可以通过 FMC 连接器提供给 AFE EVM。 这两个引脚的 Y4和…
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  • [参考译文] ADS54J66EVM：JESD 同步、ADC 寄存器读回和复位问题。

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    Other Parts Discussed in Thread: ADS54J66EVM , LMK04828 , ADS54J66 , TSW14J57EVM 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/902389/ads54j66evm-jesd-sync…
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  • [参考译文] DAC34H84：通过 Xilinx FPGA FMC 适配器连接 DAC 34H84的所有四个通道

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    Other Parts Discussed in Thread: DAC34H84 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/818993/dac34h84-interfacing-all-four-channels-of-dac-34h84-through…
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  • [参考译文] ADC3643EVM：REV E 原理图的相关阐述

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    Other Parts Discussed in Thread: ADC3643EVM 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1320983/adc3643evm-clarification-about-the-rev-e-schematic …
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  • [参考译文] TMS320F28P659DK-Q1：与 SOCA 锁存的 eQEP

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    Other Parts Discussed in Thread: SYSCONFIG 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/1583843/tms320f28p659dk-q1-eqep-latching…

  • RE: [参考译文] ADC09QJ1300EVM：ADC09QJ1300EVM 相关问题

    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好、Jeno： 从您分享的文档来看、您好像在使用板载50 MHz 参考。 这种特定的工作模式具有一些复杂的特性。 从分享的屏幕截图中、我们可以看到 FPGA_GBT 时钟来自 ADC TRIGOUT 引脚。 此模式的工作方式是在 ADC 内部。PLL 将生成转换器时钟、s PLL 将生成串行器/解串器时钟、而 TRIGOUT 将获取串行器/解串器时钟并将其分频以输出 FPGA…

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