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  • [参考译文] ADC31JB68：如何为500MHz 采样数据设置 ADC 和 FPGA

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    Other Parts Discussed in Thread: ADC31JB68 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/895047/adc31jb68-how-to-setup-the-adc-and-fpga-for-500-mhz-sample…

  • RE: [参考译文] BQ25792：快速充电时的 IBAT 0mA

    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 你(们)好、Jared 这是 CE 被拉低后几秒钟内的所有寄存器。 提供12V 电压、具有2A 限制。 我看到0mA 取自 PSU (充电器) Reg: 0, value: 0x12 0b10010 //VSYS min 18 * 250mV + 2500mV = 7000mV Reg: 1, value: 0x3 0b11 Reg: 2, value: 0x48 0b1001000…

  • RE: [参考译文] ADS54J60：在接收数据中卡住的位

    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 我刚刚按照 slau711中的说明尝试使用高速数据转换器专业版附带的构建。 当需要将 FMC VADJ 更改为1.8V 时、读取 FMC HPC 时会显示该卡不存在。 无论如何、我尝试继续为1GHz 参考设置 LMK 和 ADC、尽管说明不适用于 ADS54J60EVM、因此指南中的菜单不匹配。 然后、我尝试进行数据采集并得到超时错误。 在我们有与指南不同的电路板的情况下、读取…
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  • RE: [参考译文] ADC12J2700EVM：连接到 Xilinx Kintex Ulstrascale + KCU116开发板

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 你好、Jim 嗯、我不确定具体的问题是什么 LMK0482 通过 FMC 连接器提供两个参考时钟、 第一个是原理图上的 DEVCLKARX、即收发 器参考时钟、以200MHz 运行 第二个是 我以 100Mhz 运行的 DEVCLKBRX、它与 芯片也通过 FMC 连接器发送的 SYSREF 同步。 我不知道~SYNC 是否被置位我只连接了一个进入 ADC 本身的引脚、而没有连接…
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  • RE: [参考译文] ADC12J4000EVM：在ADC12J4000上使用时间戳进行捕获

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好，Max KCU105是否配置为在FMC引脚H31上输出单端同步~Ω 信号？ 与此ADC EVM最常使用的TSW14J56EVM捕获板在FMC引脚G12和G13上具有差分同步~，在FMC引脚H31上具有单端同步~。 此致， Jim B
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  • [参考译文] ADC12DJ5200RFEVM：如何正确使用 Xilinx FPGA (VCU118)？

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    Other Parts Discussed in Thread: ADC12DJ5200RFEVM 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1075530/adc12dj5200rfevm-how-can-it-work-correctly-with…
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  • [参考译文] TI-JESD204-IP：修改 TI204C-IP 并确定 ADS54J64和 IP 的时钟

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    Other Parts Discussed in Thread: ADS54J64EVM , ADS54J64 , ADS58J64EVM , LMK04828 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1158213/ti-jesd204-ip-modifying…
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  • [参考译文] ADC12DJ3200：用于同步的3个 ADC12DJ3200数据通道之间的长度匹配

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    Other Parts Discussed in Thread: ADC12DJ3200 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/869929/adc12dj3200-length-matching-between-data-lanes-of-3…

  • RE: DA8820评估板的控制模块

    可是文档上显示的DAC-FMC-Adapter 是用于高速DAC的，但是DAC8820不是高速DAC且文档中所列的也没有DAC8820. 因为我不是专门做硬件的，我的目的是使用做好的评估板实现我所需要的要求，主要是能够连续向DAC输入数据进而产生所需要的波形，然后我们已经有了xilinx的FPGA Virtex-5开发板， 我想问一下的是能不能用我们的FPGA板根据DAC8820的数据手册产生合适的时序控制DAC8820评估板？

  • [参考译文] ADS62P49：LVDS 至 LVCMOS 位映射

    Other Parts Discussed in Thread: ADS62P49 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/839184/ads62p49-lvds-to-lvcmos-bit-mapping 器件型号： ADS62P49 大家好、我正在使用…

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