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  • RE: [参考译文] TLV320AIC3204：正确的时钟设置

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 实际上、这是一个旧日志。 我们要发送的当前命令和读回的值如下所示： Aura V0.06 Starting up ----DEBUG-MODE-ON---- Applied DSP HARDWARE reset Released DSP HARDWARE reset W 0x00 0x00 (Write PAGE reg) W 0x01 0x01 (write register…

  • RE: CCS6.0什么情况下会自动断开目标板

    包含JTAG接口的话，请参考control card的原理图 F2837x_180controlCARD_R1_3_SCH_02Oct2015.pdf
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  • RE: 咨询锂电池充电IC

    已解决
    我上传了一个充电方案的文档，你可以根据文档来做适当的选型；
    • TI电池管理解决方案[1].pdf

  • AIC3254使用的一些问题

    以下图片是我的GDE设置,输入的IIS 4个信号正常,现在没IIS_DATA输出. 在我的设计里,AIC3254作为miniDSP使用,工作过程:IIS输->DSP信号处理->IIS输出 以下是我的初始化代码: /* 自恢复软复位 */ const reg_value aic3254_cReset[]= { 0,0, 1,1 }; /* 电源设置 */ const reg_value aic3254_pSet[]= { { 0,0x01}, // # reg[ 1][ 1] = 0x08 ;…

  • TLV3254工作电流怎么这么大30mA?不是说只有几个毫安吗

    我的3254只提供一个MCLK，BCLK和WCLK OUTPUT，采用44.1K的采样率，GDE里面如下 CS里面设置生成的的文件如下 { 0,0x00}, // # reg[ 0][ 1] = 0x01 ; Initialize the device through software reset { 1,0x01}, {254,0x0A}, { 0,0x01}, // # reg[ 1][ 1] = 0x08 ; Power up AVDD LDO; Disable weak AVDD to DVDD…

  • RE: AIC3256 单芯片实现6路音频输入问题

    Hi Airwill ： 时序图来自于《TLV320AIC3256 Application Reference Guide〉具体文档请见附件。 另外：用Single-Ended 信号的话，能否采集6路输入音频信号？ 能否给一个多路通道的采集时数据传输时序或者实例？
    • TLV320AIC3256 Application Reference Guide.pdf
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  • TLV320AIC3254初始化配置问题

    已解决
    Other Parts Discussed in Thread: TLV320AIC3254 , TLV320AIC3254EVM-K 你好，之前没有接触过DAC的芯片，对这个不是很熟悉，我现在有个蓝牙音响须要用到这个芯片TLV320AIC3254来处理I2S DAC转换 蓝牙这边是从模式，AIC3254是主模式，我现在贴这个初始表出来请大家帮我改一下这个配置（ //DAC 2S master mode i 24BIT/192ksps Sample Rate and High Performance. …

  • RE: 音频FAQ~持续更新ING

    音频转换器 [AIC3254] How and when can the C-RAM and I-RAM of the miniDSP be accessed? I. When a miniDSP is powered off: Its C-RAM (or coefficient memory) can be accessed by the control bus. The miniDSP does not have access to C-RAM. Its I-RAM (or instruction…

  • RE: 【NEW 新增电流检测电子书下载】模拟工程师电路设计指导手册 + 有关运算放大器设计主题的博客文章汇编

    Analog Engineer’s Pocket Reference.pdf Data Converters.pdf

  • RE: DAC38RF80EVM: 与TSW14J56调试

    它们之间有一个关系，但它取决于几个因素，如serdes速率、插值速率和FPGA IP核使用的PLL 分频器。FPGA参考时钟可以是一系列值。TSW14J56EVM使用的固件由第三方为TI开发，此项目的设计文件见附件， 5504.TSW14J56revD Design Document.doc 这是关于你的问题我能提供的唯一信息。固件源代码可从TI网站上的TSW14J56EVM产品文件夹下载。

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