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  • LMK04828BEVM: 时钟芯片的只读寄存器错误

    TI 认为已经解决
    Part Number: LMK04828BEVM 请问在寄存器还没配进去之前，读只读寄存器全是00.0F,FF，这是什么情况呢

  • [参考译文] LMK04828BEVM：当在 clk104射频附加卡中从 SFP 恢复时钟生成 DAC 参考时钟时、PLL1锁定失败

    Other Parts Discussed in Thread: LMK04828 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1424537/lmk04828bevm-pll1-lock-fails-when-generating-dac-ref-clk-from…
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  • [参考译文] LMK04828BEVM：PLL2锁定

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1428587/lmk04828bevm-pll2-lock 器件型号： LMK04828BEVM 工具与软件： Clkin1：电源抑制比(122.88MHz)/0dBm 外部 VCO：122.88MHz PLL2未锁定…
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  • [参考译文] LMK04828BEVM：LMK04828BEVM

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1416770/lmk04828bevm-lmk04828bevm 器件型号： LMK04828BEVM 工具与软件： 我目前正在使用 LMK0428EVM、并计划将评估模块集成到定制机箱中。 为正确设计外壳并钻孔必要的安装孔…
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  • [参考译文] LMK04828：具有100 MHz 的 LMK04828

    已解决
    Other Parts Discussed in Thread: LMK04828 , LMK04821 , LMK04826 , LMK04828BEVM 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1391104/lmk04828-lmk04828-with-100…
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  • [参考译文] LMK04828BEVM：LMK04828BEVM 使用问题

    已解决
    Other Parts Discussed in Thread: USB2ANY 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1342498/lmk04828bevm-lmk04828bevm-usage-problem 器件型号： LMK04828BEVM 主题中讨论的其他器件…

  • [参考译文] LMK04828BEVM：LMK04828BEVM

    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1333885/lmk04828bevm-lmk04828bevm 器件型号： LMK04828BEVM 您好！ 只需快速回顾一下这个问题。 您可以再次发送此文件与最新版本的 pllainumsim 因为它似乎当我加载我不能打开的文件…

  • RE: [参考译文] PLL1和 PLL2

    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 比希努 我将关闭这个重复的主题。 请参阅原始主题 https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1318479/lmk04828bevm-pll1-and-pll2 此致、 将会
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  • RE: [参考译文] LMK04828：有关如何在不同电路板上的 LMK04828B 输出时钟之间实现确定性相位关系的问题

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好、William： 我意外地读了下面的线程。 在该线程中、 采用零延迟模式时、10MHz 输入参考时钟和2MHz 参考频率时钟环回 PLL1的 N 分频器。 Ajeet Pal 建议没有必要重置 参考频率分频器、因为如果每个 LMK 设备都在同一相位看到参考时钟、ZDM 已经确保了不同电路板上的输出参考频率边沿对齐。 但您说过、在没有同步的情况下、这种 ZDM 在本质上不再是确定性的…
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  • RE: [参考译文] LMK04828BEVM：具有外部时钟设置的 LMK04828BEVM、60MHz

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 亲爱的 维森特, 感谢您的 建议、 我已将 评估板硬件更改为 osc_in 外部时钟60Mhz、物理隔离 内部振荡器现在 我可以用 PLL2配置产生800MHz 和100Mhz 关于 普拉德普

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