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找到 84 个结果 查看 问题 帖子 排序依据

  • RE: [参考译文] LMK04832-SP：传播 良好

    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 尊敬的 Robert： 我很快就会回复您。 谢谢！ Michael
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  • [参考译文] LMK04832-SP：使用 EMI 转换后的 IBIS 模型的 LVDS 输出 SIM

    已解决
    Other Parts Discussed in Thread: PSPICE-FOR-TI , LMK04832-SP 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1394074/lmk04832-sp-lvds-output-sim-using-converted…

  • RE: ADC12DJ5200-SP: 数据转换器论坛

    TI 认为已经解决
    Other Parts Discussed in Thread: LMK04828 , LMX2594 , LMK04832 , USB2ANY 谢谢，Danie！ LMK04828输出时钟能实现上面的框图吗？有两路SDCLKoutput7和9输出40.625M，DCLKoutput输出260M，看规格书SDCLK和DCLK是一样的输出频率？ TICS pro能导出功能文件直接烧录芯片吗？还是在线操作寄存器？ 时钟原理图帮忙review，能方便提供联系方式吗？我是上海橙科微王小秋，13917788754…
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  • [参考译文] LMK04832-SP：VDD、VDD_A 电压尖峰

    已解决
    Other Parts Discussed in Thread: LMK04832-SP 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1412222/lmk04832-sp-vdd-vdd_a-voltage-spike 器件型号： LMK04832-SP 工具与软件…
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  • RE: [参考译文] LMK04832-SP：输入引脚损坏等级

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 Robert 如果输入是交流耦合的、则在未上电器件的 LVDS 输入时不会出现问题、如下所示。 这是因为 LVDS 信号的摆幅为400mV 左右、这符合下面提到的要求。 更多信息、请参阅 数据表的9.3.1冷备用注意事项部分。 如果未对未通电设备的输入进行交流耦合、请按照以下电路进行操作： 此致！ Andrea
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  • RE: [参考译文] LMK04828：LMK04828与 LMK04610

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 你好、罗希特、 LMX0461x 是由德国团队设计的半数字抖动清除器 PLL。 这些器件设计用作 LMK0482x 抖动清除器与我们产品系列提供的 DPLL (网络同步器)之间的间隙。 遗憾的是、由于我们无法控制的原因、我们的支持非常有限、并且器件有一些已知错误。 SYNC/SYSREF 不够确定、并且输出之间的偏斜可能在 PVT 上大约数百 ps。 LMK0482x 系列是第三代抖动清除器…
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  • RE: [参考译文] LMK04832-SP：LMK04832-SP

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 解决差分正弦波问题。 我想知道 是否 可能有差分方波。 LVDS、LVPECL 和 CML 是差分方波类型。 [报价 userid="539691" url="~/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1345338/lmk04832-sp-lmk04832-sp/5243982 #5243982…
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  • RE: [参考译文] LMK04832-SP：LMK04832-SP

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 除了适用于整个 SYSREF 分配路径和每个 SYSREF 输出的全局 SYSREF_DDLY 字段外、每个通道中都存在一个本地模拟延迟、可将总本地 SYSREF 延迟延长约610ps。 如果您可以接受 SYSREF 脉冲以多个阶段到达(某些 JESD IP 允许某些或任意 SYSREF 周期数的偏移)、您可以使用 SCLKx_y_DIS_MODE 和 SYSREF_GBL_PD…
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  • [参考译文] LMK04832-SP：LMK04832-SP

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1368896/lmk04832-sp-lmk04832-sp 器件型号： LMK04832-SP 工具与软件： 适用于 SYSREF 分配路径的延迟阶跃
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  • [参考译文] LMK04832-SP：如何终止未使用的 CLKIN0、CLKIN0*和 CLKIN1/FBCLKIN/FIN1。 CLKIN1*/FBCLKIN*/FIN1*

    已解决
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1358903/lmk04832-sp-how-to-terminate-unused-clkin0-clkin0-and-clkin1-fbclkin-fin1-clkin1-fbclkin-fin1 器件型号： …

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