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  • RE: [参考译文] SN65LVP17：Xilinx 7系列 LVDS_25至 LVPECL 转换

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 尊敬的 David： 上面列出的器件都是 LVPECL 输入/输出、但 看起来您对 LVDS / LVPECL 转换感兴趣。 我在我们的产品系列中筛选了标准 LVDS 输入和 LVPECL 输出：LVDS、M-LVDS 和 PECL IC 产品选择| TI.com。 搜索中的所有器件都支持上述数据速率。 实现方式是、请随时点击搜索中的器件、查看它们是否提供了 EVM 用户指南。 (此内容位于…

  • RE: TLV3801: 请问TLV3801是否可以双电源轨供电？

    您好，抱歉上周后面几天请假了，回复晚了。 CML输出上拉的目的是为了给CML输出提供直流偏置电压，保证和源阻抗匹配。如下： 我附上一篇不同电平之间交流耦合的应用手册，里面详细介绍了几种不同电平间的耦合方式电路，希望对您有所帮助： AC-Coupling Between Differential LVPECL, LVDS.pdf 　
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  • [参考译文] DAC3171：DAC3171由相同的 DA_CLK 和 DACCLK 驱动

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    Other Parts Discussed in Thread: DAC3171 , CDCE62005 , SN65LVDS101 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1193135/dac3171-dac3171-driven-by-the…
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  • [参考译文] SN65LVDS101：MADI 至 LVPCEL

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1158285/sn65lvds101-madi-to-lvpcel 器件型号： SN65LVDS101 大家好、 客户 正在寻找一个可接收0.3V 至0.6mV 振幅的 MADI 信号的 IC。 平均值为0V 并将其转换为800mV 的 LVPCEL…
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  • [参考译文] ADC3683：采样时钟(CLKP/M)差分电平(VID)

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    Other Parts Discussed in Thread: ADC3683 , ADC3683EVM , CDCE62002 , CDCM6208 , SN65LVDS101 , CDCLVP111-SP , LMX2615-SP , LMK04832-SP , SN65CML100 , CDCLVP111 , CDCE6214 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters…
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  • RE: [参考译文] SN65LVDT100：如果客户想要将DS90UR241连接到PECL，那么哪一个sn65lvdx10x是最佳选择？

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好， SN65LVDS101具有LVPECL输出，有关 详细的详细信息，请参阅第6节“设备选项”。 所有设备都需要一些电源，图表是一个简化的参考图。
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  • RE: [参考译文] SN65LVDS101：热性能信息

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好！ 在下面找到 θ 结壳(顶部)和 θ 结板值。 Theta JC、顶部 62.9 °C/W Theta JB 64.7 °C/W
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  • RE: [参考译文] SN65LVDS101：.AMI 模型

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好、Jerry、 可以将其用作短桩、是的。 AMI 模型不适用于 LVDS 器件、仅 IBIS 模型可用。 此致、 I.K.
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  • RE: [参考译文] DS92LV18：DS92lv18 clok#39；s

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好！ 您描述的时钟方案应该可以。 要求是 DS90LV18上的 REFCLK 必须与另一端(发送)的 TCLK 相同(5%以内)。 在两侧设置 TCLK 和 REFCLK 应该是可以的。 关于 PECL <-> LVDS 转换、您可以使用 SN65LVDS100和 SN65LVDS101。 有关详细信息、请参阅 SN65LVDS100数据表的应用部分。 请注意…
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  • RE: [参考译文] SN65LVDS101：使用 ibis 模型时看到不平衡的差分信号

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好 Eric、 这似乎是 IBIS 模型的一个问题、我认为如果不生成新模型、就无法修复。 遗憾的是、我们无法为此器件生成新的 IBIS 模型。 此致、 相位

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