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  • RE: SN74LVC1G08: 输出电平偏低问题

    您好， 请注意手册高电平的输入条件，0.7*Vcc= 3.5V, 并且不把输入信号的低电平与高电平之间的信号要尽可能快地通过，避免长时间造成芯片损坏。3.3V处于中间电平，请避免这种使用。
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  • [参考译文] SN74LVC1G08-Q1：数据表链接断开

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1460601/sn74lvc1g08-q1-datasheet-link-broken 器件型号： SN74LVC1G08-Q1 工具与软件： 大家好、TI.com 上的汽车版数据表链接无法正常工作。 请修复、客户需要它。 SN74LVC1G08QDBVRQ1 …
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  • [参考译文] SN74LVC1G08：在 VCC 之前施加输入

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1460274/sn74lvc1g08-inputs-applied-before-vcc 器件型号： SN74LVC1G08 工具与软件： 大家好、团队成员： 数据表指定以下内容： Ioff 支持带电插入、局部关断模式和后驱动保护 可以在 VCC 之前施加输入吗…
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  • RE: [参考译文] SN74LVC1G08：SN74LVC1G08DBV 的输出信号在上电过程中不稳定

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 低于1.65V 的最小建议电源电压时、无法保证正常运行。 具有/OE 输入的器件(例如 SN74LVC1G125、SN74LVC1G99)可确保在/OE 为高电平时禁用输出、即使在上电期间也是如此。
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  • RE: TIDA-010122: 原理图LMK04828_SYNC1和LMK04828_SYNC2电平是否有问题

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    SN74LVC1G08DCKR使用3.3V电源的话，高电平最少2V，如果只有1.8V，是不可以的。 www.ti.com.cn/.../sn74lvc1g08.pdf
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  • [参考译文] SN74LVC1G08：如果输入上下波动2V、如何告知输出信号

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1444289/sn74lvc1g08-if-the-input-fluctuates-up-and-down-2v-how-to-tell-the-output-signal 器件型号： SN74LVC1G08 工具与软件： 嗨、团队： 我的客户询问如何在存在机械抖动时告知输出逻辑…
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  • SN74LVC1G08-Q1: 如果VCC电压因为电源跌落，到了1V，请问输出信号Vo的电压会是多少，是变成高阻了，还是Vcc-0.几V？

    Part Number: SN74LVC1G08-Q1 请问如果VCC电压因为电源跌落，到了1V，请问输出信号Vo的电压会是多少，是变成高阻了，还是Vcc-0.几V？tks！
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  • RE: [参考译文] SN74LVC1G08：正在标记问题

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 尊敬的 Suri： 最后一位数字表示器件组装地点。 这是 SN74LVC1G08DBVRG4的有效顶部标记。 此致、 Owen

  • RE: SN74LVC1G08: 输出波形异常

    您好， 请查看您另一个同样问题的帖子的回复。 SN74LVC1G08: 输出PIN4(ALL_SYS_PWRGD_S)波形异常 - 逻辑论坛 - 逻辑 - E2E 设计支持

  • RE: SN74LVC1G08: 输出PIN4(ALL_SYS_PWRGD_S)波形异常

    您好， 通常缓慢的输入速率可能会导致器件上的振荡和高电流。 建议参考数据手册中第5页的”Δt/Δv“中的指标要求，以防止这种情况出现。 SN74LVC1G08 Single 2-Input Positive-AND Gate datasheet (Rev. Z) 下面的文档请参考。 Implications of Slow or Floating CMOS Inputs (Rev. E)

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