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[参考译文] SN74LVC1G11:3输入与门引脚1的位置?
admin
已解决
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1356410/
sn74lvc1g11
-3-input-and-gate-pin-1-location 器件型号:
SN74LVC1G11
尚不清楚引脚1在 SN74LVCG11DCK 器件封装上的位置。 如何在部件上指示引脚1?
已回答
3 个月前
逻辑(参考译文帖)
逻辑(参考译文帖)(Read Only)
Answered
RE: [参考译文] SN74AHCT74Q-Q1:FMEDA 计算文件请求
admin
已解决
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 您好、Molly: 我首先在这里提到这个答案: https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1131533/
sn74lvc1g11
-q1-about-fmeda 严格地说、我们没有任何逻辑器件的失效模式文档、因为它们的失效是不可预测的。 此致! 马尔科姆
4 个月前
逻辑(参考译文帖)
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RE: [参考译文] SN74LVC1G11-Q1:SN74LVC1G11-Q1 Tthj
admin
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请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 这是150 °C;请参阅 [FAQ]器件的最高结温(TJMAX)是多少?
8 个月前
逻辑(参考译文帖)
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RE: [参考译文] SN74LVC1G11:未上电时的输出状态
admin
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请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 是的、即使电压高于 VCC、也不会有电流流动 。
8 个月前
逻辑(参考译文帖)
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RE: [参考译文] SN74LVC1G11:高电平输入电流和低电平输入电流
admin
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请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 输入电容约为3.5 pF。 为50 pF 的负载指定了3.3V 或5V 电源下的传播延迟、对应于大约14个栅极。 使用16个栅极(以及大约1 pF / cm 的额外迹线电容)会使边沿比指定速度慢一些。
9 个月前
逻辑(参考译文帖)
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RE: [参考译文] SN74LVC1G11:与门未提供正确的输出
admin
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 理论上、这应该起作用。 (240mV 已足够低。) 其他两个输入电压是否有效? 还能显示输出电压吗?
8 个月前
逻辑(参考译文帖)
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RE: SN74LVC1G11: 输入输出电平
Jianxin Luo
已解决
明白,谢谢~
1 年多前
逻辑
逻辑论坛
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RE: [参考译文] SN74LVC1G11:Verilog 模型
admin
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请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 您好! 我们通常不会创建或提供 Verilog 模型、但我希望以下代码能够正常使用: module AND3(input a, input b, input c, output reg y); always @(a, b, c) y = a & b & c; endmodule
1 年多前
逻辑(参考译文帖)
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RE: [参考译文] SN74LVC1G11:级联与门-使用另一与门的输出为与门供电
admin
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请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 感谢 您的回复 Emrys Maier 。 您的冗余设计更简单、更具可预测性!
1 年多前
逻辑(参考译文帖)
逻辑(参考译文帖)(Read Only)
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RE: [参考译文] SN74LVC1G11:电压输出
admin
已解决
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。 您好、Marvin、 是的、您回答正确。 只要输入大于 V_IH 且小于绝对最大额定值、输入就会被检测为"高电平"。 一个注意事项是关注 V_IL 电平-当由1.8V 电源供电时、V_IL 值将非常低(0.63V)、因此它可能与某些3.3V 或5V V_OL 电平发生冲突。
1 年多前
逻辑(参考译文帖)
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