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求ti工程师，怎么下载ti官网上的第三方软件3L Diamond C6000和3L Diamond TCP/IP Stack

JY LI

好了很久都找不到下载链接，请好心人指点，谢谢。或者有的请给我下，邮箱lijia1984121@163.com
- 10 年多前
- 处理器
- 处理器论坛

RE: [参考译文] ADC12DJ5200RF：ADC12DJ5200RF JESD204C 示例

admin

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。您好！您需要通过以下链接提交申请。 https://www.ti.com/tool/TI-JESD204-IP 此致、 Neeraj
- 3 年多前
- 数据转换器（参考译文帖）
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RE: [参考译文] DAC12DL3200：DAC12DL3200：FPGA 参考设计

admin

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。尊敬的 Samet：虽然名称是 ADC12DL3200、但 TSW14DL3200是为 ADC 和 DAC EVM 创建的、因此我的理解是、它还包含 DAC 的文件。请注意、创建此固件的团队已解散、因此、我们将无法对有关此固件的任何问题提供支持。我建议查看如何使用 TI-204C-IP 、我们将能够对其提供支持。 www.ti.com/.../TI-JESD204-IP …
- 2 年多前
- 数据转换器（参考译文帖）
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RE: [参考译文] DAC37J84EVM：DAC37J84EVM 板和 Kintex-7 KC705 FPGA 板

admin

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 Trang、我已将此事转给我们的 TI JESD204 IP 专家。他们的回复可能会因圣诞假期而延迟。此致、 Jim
- 3 年多前
- 数据转换器（参考译文帖）
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RE: [参考译文] TSW14J58EVM：在高速数据转换器专业版中未连接到#39；t

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。您好、Diego、您能否通过以下链接提交申请并获取 TI-JESD 项目？ https://www.ti.com/tool/TI-JESD204-IP 此致、 Neeraj
- 3 年多前
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RE: [参考译文] ADC31JB68：ADC31JB68EVM 是否仍可用？

admin

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。尊敬的 Mark：感谢您的参与。采样时钟抖动不会直接影响 JESD、仅影响 ADC 中内部采样网络的模拟部分。如果采样时钟抖动较差、这将降低 SNR。 JESD 链路是一种协议、与此指标无关。采样时钟在 JESD 链路的 ADC 中乘以... 不在 FPGA 中。以便更好地理解与转换器相关的 JESD 链路。下面是一些应用手册： https://www.ti…
- 1 年多前
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[参考译文] ADS54J60EVM：时钟放大器；ZCU102的限制

admin

Other Parts Discussed in Thread: TI-JESD204-IP , ADS54J60EVM , ADS54J60 , LMK04828 , ADS54J42 , ADS54J20 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1015668…
- 4 年多前
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RE: [参考译文] AFE7900：AFE7900 TI-204B/C 接口

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。你好、Muhammad、很抱歉耽误你的时间。您的计算结果是正确的。输出采样率为122.88MSPS。但这不需要等于 FPGA 参考时钟。在 TI JESD204 IP 中、SERDES 通道输出数据被并行化到80个流。这就是基准时钟将等于61.44MHz 的原因。每个时钟周期将输出两个数据样本。此致、维贾伊
- 2 年多前
- 射频与微波（参考译文帖）
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RE: [参考译文] ADC12DJ5200-SP：C 频带、X 频带、带极火

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。尊敬的 Byungsoo：对迟交的答复深表歉意。我们现在正在创建客户配置、但我们有以下关于您的模式的问题。 JESD 编码是否必须为8b10b？当单通道以1500MSPS 数据速率和4个通道运行时、通道速率会变为15Gbps、高于 FPGA 支持的速率。如果我们更改为64b66b 编码、则可以使用相同的 AFE 配置、但通道速率现在将为12.375Gbps。此外…
- 1 年多前
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RE: [参考译文] AFE7900EVM：同时捕获两条 Rx 路径

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。嗨、Haizouni：目前、我们无法与 TSW14J58同步捕获两个 Rx 通道。我已将此问题告知了我们的软件团队、并将请求在下一个设计中添加此功能。如果需要同步捕获两个 Rx 通道、则可采取的一条路径是使用我们的 TI204c-IP、并为 AFE+TSW14J58创建设计、从而可通过 Vivado 捕获数据。要接收 TI204c-IP 的访问权限、您可以通过以下链接申请许可…
- 2 年多前
- 射频与微波（参考译文帖）
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