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  • [参考译文] TIDA-00996：有关 TIDA 性能的阐述

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    Other Parts Discussed in Thread: TIDA-00996 , DAC38J84 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/tools/simulation-hardware-system-design-tools-group/sim-hw-system-design/f/simulation-hardware-system-design-tools…
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  • [参考译文] TIDA-00996：设计文件中缺少文件

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    Other Parts Discussed in Thread: TIDA-00996 , DAC38J84 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/tools/simulation-hardware-system-design-tools-group/sim-hw-system-design/f/simulation-hardware-system-design-tools…

  • [参考译文] TIDA-00996：多发送器的多 DAC 同步

    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/tools/simulation-hardware-system-design-tools-group/sim-hw-system-design/f/simulation-hardware-system-design-tools-forum/683169/tida-00996-multiple-dac-synchronization…

  • RE: [参考译文] DAC38J84EVM：使用 DAC38J84EVM 查询确定性延迟的可变延迟

    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好！ 您可以在以下应用手册中查看时钟设置： https://www.ti.com/tool/TIDA-00996 您很可能需要使用 LMK04828的零延迟模式。 -Kang

  • RE: [参考译文] DAC38J84EVM：有关 DAC38J84EVM 的多 DAC 同步的查询

    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 Prateek、您好！ 您可以首先查看以下配套资料： https://www.ti.com/tool/TIDA-00996 我将进一步调查您的问题、进行审查并提供反馈。 -Kang
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  • RE: [参考译文] TSW40RF80EVM：尝试在多个 TSW40RF80EVM 板之间同步射频 DAC 输出

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好！ 您可以参考以下 TIDA https://www.ti.com/tool/TIDA-00996
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  • [参考译文] DAC38J84：4路独立输出

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    Other Parts Discussed in Thread: DAC38J84 , TIDA-00996 , DAC38J84EVM 请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/768855/dac38j84-4-independent-outpu…
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  • RE: [参考译文] AFE7920：多器件同步

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 尊敬的 Jongroh： 请告知需要相对相位同步或绝对时间同步的多个 AFE7920之间的 RX 和 TX 频率。 相对相位同步意味着需要校准 TX 和 RX 之间的相位差。 相位差可以任意标记在任意时刻、只要两个输出(或输入)之间的差值为零、就可以实现相对相位差。 绝对时间对齐意味着一个通道的"启动"阶段需要与另一个通道的"启动"阶段对齐。 起始时间标记在开始时标记为1…
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  • RE: [参考译文] TSW14J56EVM：外部图形文件格式；多通道

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好 Justin、 请参阅随附的、了解通过 HSDC Pro /TSW14J56EVM 发送的4通道图形文件的格式。 我相信您提出的要求是可以实现的、但这可能需要两个文件。 我将进一步研究这一点。 e2e.ti.com/.../DAC38J84-Test_5F00_368.64MSPS_5F00_100MHzSignal.csv.zip 您如何确认与 DAC 和 TSW14J56EVM…
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  • RE: [参考译文] DAC38J84：SYSREF 和 DAC 输出时序变化等

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。 您好 Karita [引用 user6379132"]"问题" Q1)例如、如果寄存器固定为特定设置、DAC 中的内部延迟是恒定的还是波动的？ 例如、DAC 中特定寄存器设置的内部延迟是恒定的、还是存在变化的因素？ 它可能与 FPGA 的 IP 内核有关、但我想知道是否可以在每次启动时输出模拟信号而不会出现任何触发时序波动。[/引述] 内部 DAC JESD204…

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