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SN74AC74将CLK和D端使用同一个信号，PRE固定为高，CLR可控制，先将CLR拉高，CLK和D输入上升沿，Q输出高，将CLR拉低，Q输出为低，然后将CLR拉高，再将CLK和D端从高拉低的过程中（下降沿），Q输出从0变为高，请问大神是什么原因造成的呢？规格书上显示上升沿动作，怎么会下降沿也动作呢？谢谢
看看设置蛮正常. 会不会的噪声的影响, 我曾经也是这个芯片因为受外界影响经常误触发
