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[参考译文] INA3221:时钟延展问题

Guru**** 2382480 points
Other Parts Discussed in Thread: INA3221
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/amplifiers-group/amplifiers/f/amplifiers-forum/1325808/ina3221-clock-stretching-issue

器件型号:INA3221

大家好、

您可以帮助检查 INA3221的时钟延展机制吗?

我的客户在使用 INA3221时遇到时钟延展问题、导致主机错误读取数据。

附加了相关波形、时钟延展周期约为80ms。

根据编码模式的计算、BMC 应该错误地将时钟延展期间的值用作有效数据(通道3总线电压-高位0x03 -低位0xff)、并返回相对较高的1.016V 结果。

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    添加更多评论:

    I2C 的数据速率为100kHz。

    此致、

    马特.

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    Matt、

    今天是在美国的假期。  有人很快就会找到你。

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    Matt、您好!

    感谢您使用 TI 论坛。 根据 INA3221规范、似乎您将时钟延展得太长。  

    Unknown 说:
    时钟延展期大约为80ms

    但 INA3221数据表显示这是最大限值:

    此致、

    米奇

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    尊敬的 Mitch M:

    感谢您的答复。

    我有一件事需要与你确认。

    我们的 INA3221是否没有内部 I2C 时钟延展机制? 该80ms 拉伸是由主机引起的吗?

    感谢您投入宝贵的时间与精力。

    此致、

    马特.

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    Matt、您好!

    正确、当主机将 SCL 保持为低电平时、INA3221的时钟延展不能超过28ms。

    此致、

    米奇