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[参考译文] TM4C129XNCZAD:UART TX 中断未按预期工作

Guru**** 2411970 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/arm-based-microcontrollers-group/arm-based-microcontrollers/f/arm-based-microcontrollers-forum/1030779/tm4c129xnczad-uart-tx-interrupt-not-functioning-as-expected

器件型号:TM4C129XNCZAD

您好!

在处理项目时 、我遇到了一个问题。

我 注意到 UART 中断的运行方式并不像数据表中描述的那样。

主要是、我希望 在 TX FIFO 为空时触发中断、但只有当数据被写入数据寄存器时才触发中断。

这似乎是以下 讨论中提到的已知问题:
https://e2e.ti.com/support/microcontrollers/arm-based-microcontrollers-group/arm-based-microcontrollers/f/arm-based-microcontrollers-forum/603001/tm4c129encpdt-uart-transmit-interrupt-not-being-triggered

此问题是否已在新版本的西梁上得到解决、或者是否是所有西梁版本上的问题?

此外、是否还有另一种触发 TX 中断的方法、其中不包括写入数据寄存器?
(也许 我漏掉了一些明显的东西)

提前感谢。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、Strahinja、

    由于讨论了该帖子、因此器件没有更新的版本、唯一可用的版本是修订版3。

    我认为该主题中的信息与您将会发现的情况分析一样详细、数据表对此非常清楚:

    ■如果 FIFO 被使能、并且发送 FIFO 在经过编程的触发条件下前进

    TXRIS 位被置位。 因此、发送中断基于电平转换

    FIFO 必须写入超过设定的触发深度、否则不再发送中断

    将会生成。 发送中断通过向发送 FIFO 中写入数据来清除、直到发送 FIFO 中写入数据为止

    大于触发电平、或通过向 TXIC 位写1清除中断来清除中断。

    此致、

    Ralph Jacobi