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[参考译文] TM4C1231E6PM:Tiva C PF0 NMI 特性、

Guru**** 2378650 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/arm-based-microcontrollers-group/arm-based-microcontrollers/f/arm-based-microcontrollers-forum/774616/tm4c1231e6pm-tiva-c-pf0-nmi-feature

器件型号:TM4C1231E6PM

您好!

您能否确认 PF0引脚在复位(POR)后将处于 NMI 模式?

数据表"5.1信号描述"提到复位后、两个 NMI 引脚将处于 GPIO 模式。
' NMI 信号是两个 GPIO 信号的复用功能、复位后用作 GPIO 功能。'

同时、"10.4寄存器映射"提到它将是 NMI。
除了 GPIO 管脚外、GPIOCR 寄存器的默认复位值为0x0000.00FF
JTAG 和 SWD 管脚的配置(管脚编号见1200页的“信号表”)。 以确保这一点
JTAG 和 NMI 引脚不会意外编程为 GPIO 引脚、这些引脚默认为锁定的、不可锁定。"

请告诉我们哪项陈述是正确的。
如果该引脚默认为 NMI 引脚、那么我们是否需要任何外部上拉/下拉来避免
是否有任何不必要的 NMI 中断?

此致
巴杜语

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    您好、Paddu、

    这两项陈述都是准确的。 第一条语句中的操作字是*函数*。 这并不意味着它已配置、只是它可以用作 GPIO。 在这里、更多 DS 信息可能会有所帮助。

    首先、有关 NMI 的更多信息:

    ' NMI 信号是 GPIO 端口引脚 PD7或 PF0的备用功能。 替代功能
    必须在 GPIO 中启用该信号才能用作中断、如所述
    第613页的“通用输入/输出(GPIO)”。 请注意、启用 NMI 备用功能
    需要使用 GPIO 锁定和提交功能、就像与关联的 GPIO 端口引脚一样
    JTAG/SWD 功能、见649页。"

    然后、GPIOCR 寄存器用于 GPIO 确认。 有关它的更多信息是:

    "该寄存器用于防止对控制的寄存器进行意外编程
    连接到 NMI 和 JTAG/SWD 调试硬件。 位来实现的
    对于 NMI 和 JTAG/SWD 管脚、GPIOCR 寄存器为0 (见1075页的"信号表")
    对于管脚编号)、NMI 和 JTAG/SWD 调试端口只能转换为 GPIO
    写入 GPIOLOCK、GPIOCR 和相应的写入操作
    寄存器。
    因为这种保护当前只在 NMI 和 JTAG/SWD 管脚上执行
    (管脚编号见1075页的“信号表”),GPIOCR 寄存器中所有其它位
    寄存器不能写入0x0。 这些位被硬接线至0x1、以确保它
    始终可以将新值提交到 GPIOAFSEL、GPIOPUR、GPIOPDR、
    这些其他引脚的 GPIODEN 寄存器位。"

    此处的目的是防止用户意外地对各种可用的 GPIO 功能进行编程、而无需特意使用提交功能。

    虽然 NMI 在复位后可以*用作 GPIO,但它不会*配置*为 GPIO,并且配置由 GPIOCR 保护,因此只有在事先使用 GPIO 提交时才能进行配置。
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、Ralph、

    非常感谢您的详细解释。

    那么、结论是、PF0引脚除非配置(提交)、否则不会处于 NMI 模式或 GPIO 模式?

    我们刚刚尝试在 LaunchPad 上测试此引脚。
    加电后、该引脚似乎不起 NMI 引脚或 GPIO 引脚的作用、
    我们还确认、只有在配置完成后、此引脚才会用作 NMI 引脚。

    您是否可以确认、默认情况下、上电后 PF0引脚不会处于 NMI 模式?

    此致
    Paddu

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    您好、Paddu、

    是的、我可以确认。

    请参阅表10-1。 数据表中具有特殊注意事项的 GPIO 引脚、清楚地表明 NMI 默认复位状态为 GPIO。