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[参考译文] PCM1865:PCM1865主时钟输出

Guru**** 2382630 points
Other Parts Discussed in Thread: PCM1865, PCM1807
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/1102155/pcm1865-pcm1865-master-clock-output

部件号:PCM1865
主题: PCM1807中讨论的其他部件

您好,

我正在尝试替换PCM1865设计中使用的ADC。 在我以前的设计中,我使用12.288MHz振荡器作为ADC的时钟源,然后通过XO引脚将此时钟输出到一个大型DSP。 此DSP是“主要”IC,因此它将此ADC用作某些信号的输入。 我正在使用的此DSP为其全场生物生成BCLK和LRCLK信号。

我的问题是:我可以使用XI针来生成MCLK信号并通过XO针输出到我的DSP,同时使用输入时钟BCLK和LRCLK吗?

提前感谢。 此致,

曼努埃尔

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    Manuel,您好!

    这可能会根据您的布局而起作用,但我担心LRCLK和BCLK与MCLK同步。 您最好卸下振荡器并将BCLK用作PLL的输入,以便在芯片上生成MCLK。 通过检测BCLK和LRCLK频率,此零件可以将PLL自动配置为所需的任何值。

    此致,

    Jeff

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    您好,Jeff:

    非常感谢您的快速回答。 因此,如果我理解正确:

    • 建议的解决方案是将振荡器输出路由到我的DSP,维护从DSP到BCLK和LRCLK线路ADC的相同路由,并让ADC在感应这些BCLK,LRCLK线路时自动生成其时钟。 对吗?
    • 如果是,PCM1865中是否有任何配置,以便自动配置其PLL参数?
    • 如第42页的表11所示,第7行显示了所需的配置(48kHz和256 BCLK/LRCLK比率)。 是否可以自动配置,或者是否应该更改设置以匹配数据表第44页表13中第7个数据行中的配置?
    • 此外,对于硬件设计,如果我不使用XI和XO针,应该保持它们未连接还是上/下拉?

    为了提供更多的上下文,我的DSP采用8通道TDM流,在该流中,它每帧发送256个BCLK脉冲(即每个LRCLK周期)。 我使用它的采样频率为48kHz。 DSP也可以在2通道I2S中配置,但我需要4个ADC通道,因此我猜此模式不适合我的应用。

    此外,我还有更多问题:

    • 我正在为12.288MHz MCLK使用此振荡器(ABRACON ASFL1-12.288MHz-LR)。 使用此振荡器驱动DSP芯片,此ADC芯片和辅助ADC (PCM1807)是否可能(并且可以)?
    • 是否可以按以下格式输入双通道信号(来自PCM1807):
      • A) 24位,MSB优先,I2S (FMT 0)
      • 或b) 24位,MSB优先,左对齐信号(FMT 1)
      在DIN功能中(通过GPIO1/2/3)和输出DOUT2功能(通过另一GPIO1/2/3引脚)? 而且,在通过DOUT输出4个转换的信道时,是否可以这样做?

    非常感谢! 此致

    曼努埃尔

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    Manuel,您好!

    这里有很多问题,如果我不能一次回答所有问题,请提前道歉。

    您的理解是正确的。 只要CLKDET_EN (第0页,0x20)设置为0,PLL分隔器将自动配置。 表11仅显示了支持的频率比率。 表12提供了有关所有应设置值的更多信息。 这是在自动配置出现问题时手动编程/交叉检查的参考。 PLL应感应BCLK和LRCLK值并自行配置。  

    您可以让XI XO引脚保持浮动,因为当配置PLL时,互锁将从系统完全断开这些引脚。 请参阅计时树以查看此信息。  

    我不能建议振荡器是否可以与DSP配合使用,但您应该能够使用相同的振荡器驱动两个TI器件。 可能需要端接电阻器以防止反射。

    您可以接收任一格式。 限制是它是24位2通道信号。

    每个GPIO都可以使用寄存器16和17单独配置。 您可以将其中一个配置为DIN,另一个配置为DOUT2。

    通过使用 DOUT.DINI2S技术中的数字混合功能,您应该能够在9.3 上发送12.2 通道,并在DOUT2上发送信号。  

    此致,

    Jeff

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    您好,Jeff:

    非常感谢您的回答和分享知识。 我现在明白了如何设置芯片,以防MCLK无法提供三个芯片。 此外,感谢您确认中的串行数据的两种格式均受支持。

    关于外部ADC,是否可以将此PCM1865用作从属设备(说到时钟BCLK和LRCLK),然后接收数据? 我想只要他们有相同的BCLK和LRCLK线就可以了,对吗? (嗯,终端电阻器位于两个芯片的线路分割点)

    最后但并非最不重要的是,我无法清楚地看到如何配置混音器(正如您在第69页的表24中9.3 .12.2 .1部分中所说的那样)。 如何配置:

    • Dout用于具有(TDM格式):CH1用于ADC1,CH2用于ADC2,CH3用于ADC3,CH4用于ADC4,CH5用于DIN_1,CH6用于DIN_2?
    • 或:
      • Dout for Hing (TDM格式):CH1表示CH1L,CH2表示CH1R,CH3表示CH2L,CH2R表示CH4
      • DOUT2表示具有(TDM格式):通道1表示I2SL,通道2表示I2SR

    再次感谢您的付出和奉献。

    此致,

    曼努埃尔

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    Manuel,您好!

    是只要和ADC中的数据是同步的,从属模式就会正常。  

    混合器由系数寄存器控制。 此计算器工具将指导您如何对其进行编程: http://www.ti.com/lit/zip/slac663

    你提议的任何一种形式都应该可行,但我认为前者更简单。 似乎只需要一个DOUT引脚,如果未使用的数字PGA混音器在默认情况下未静音,您可以将其静音。  

    此致,

    Jeff

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    您好,Jeff:

    感谢您的回答。 我找不到“混音器”(使用您发送给我的文件配置)和输出之间的关系。 我认为混音器是要"汇总"信号,所以它们混合在一起(这是我不想要的)。

    所以,请告诉我,我是否正确地低估了它。 为了从模拟信号转换为数字4差分信号,并在6通道模式下以TDM模式输出这些信号,在6通道模式下还传输2个额外的串行数据输入信号,我应该:

    • 打开设备电源
    • [默认]将设备设置为从属模式(Page.0,寄存器0x20,位4设置为0)
    • [Defalut]将设备设置为自动时钟检测模式(Page.0,寄存器0x20,位1设置为1)
    • [默认]将接收模式设置为24位(Page.0,寄存器0x0B,位7-6设置为0b01)
    • [默认值]将输出数据设置为24位(Page.0,寄存器0x0B,位3-2设置为0b01)
    • 将ADC1_L的输入设置为差动VIN1 (Page.0,寄存器0x06,位5-0设置为0b1万)
    • 将ADC1_R的输入设置为差动VIN2 (Page.0,寄存器0x07,位5-0设置为0b1万)
    • 将ADC2_L的输入设置为差动VIN4 (Page.0,寄存器0x08,位5-0设置为0b10万)
    • 将ADC2_R的输入设置为差动VIN3 (Page.0,寄存器0x09,位5-0设置为0b10万)
    • 将输出数据设置为TDM模式(Page.0,寄存器0x0B,位1-0设置为0b11)
    • 将输出TDM格式设置为6-ch (Page.0,寄存器0x0C,位1-0设置为0b10)
    • (检查在将DSP与Page.0连接时是否需要任何输出TDM偏移,寄存器0x0D)
    • (检查在连接外部ADC与Page.0,寄存器0x0E时是否需要任何输入TDM偏移)
    • 将GPIO0设置为miso,GPIO1设置为DIN (Page.0,寄存器0x10设置为0x110.001万)
    • 将GPIO2和GPIO3设置为GPIO以禁用其功能(Page.0,寄存器0x11设置为0b0万)
    • [默认]将GPIO设置为输入(Page.0,寄存器0x13设置为0b0万)
    • 禁用所有中断(Page.0,寄存器0x60,位3-0设置为0b0000)
    • 禁用麦克风偏置(Page.1,寄存器0x15,位0设置为0)
    • 将设备设置为运行模式(Page.0,寄存器0x72,位3-0设置为0b1111)

    但是,对于我来说,在Page.0中设置的输出格式不清楚,注册0x0C,因为它显示:

    我不知道这些"sec_adc_HPF"和"sec_adc_LPF"是否是外部I2S数据,它看起来不是这样。 另外,对于Page.0,寄存器0x06-0x09配置,我不知道输出通道的顺序是否为VIN1, VIN2,VIN3,VIN 4或VIN1,VIN2,VIN4,VIN3。

    此致,

    曼努埃尔