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[参考译文] PCM4104：采样率变化

admin
Guru**** 2390755 points
Other Parts Discussed in Thread: PCM4104

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/984152/pcm4104-sample-rate-change

器件型号：PCM4104

您好！

出现了一个有关 PCM4104 DAC 如何处理采样率变化的问题。 以下是两种情况：

 

场景1 -如果我们在96kHz 和88.2kHz 采样率之间进行交换(保持在双速率模式下)、DAC 是否需要复位？ 我们目前正在软件控制模式下工作、以供参考。

 

方案2-在96kHz 和48kHz 之间切换时需要复位(IE、从双速率模式切换到单速率模式)

 

我们的观察结果表明、场景1在不需要复位的情况下按预期工作、而场景2似乎有问题(仍在开发固件以支持复位)。 我曾提到过在复位后执行的"初始化"、但时序图/数据表中不清楚这是否会影响音频时钟配置。 这里是否有任何具体的定序或时序指南需要遵守？

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    TI__Guru**** 2390755 points
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    尊敬的 Daviel：

    我建议在采样率变化期间将 MUTE 置为有效。  重新同步后、器件应该能够运行、但设置可能不是理想的(双速率与单速率)。  在静音期间、您可以更新寄存器。

    您看到的问题行为是什么？

    谢谢、

    Paul

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    TI__Guru**** 2390755 points
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    静音设置可能不是理想的？ 为什么呢？  

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    TI__Guru**** 2390755 points
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    我的观点是、当采样率发生变化时、您可能需要更新其他寄存器(例如过采样率)。  如果您只静音和取消静音、则寄存器可能无法对新采样率进行最理想的配置。

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    TI__Guru**** 2390755 points
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    尊敬的 Paul：

    以任何方式将静音置为有效是否会复位重新同步、或者是否会在检测到采样率变化时使 DAC 重新同步？


    对于数字衰减、阶跃变化是否在模拟输出过零期间发生、或者在每8个 LRCK 周期发生一次阶跃变化的情况下、与输出无关？


    如果编程了一个较大的阶跃(例如-20dB 至0dB 或沿这些线进行编程)、DAC 会在几个8-LRCK 间隔内平滑该步进、还是会快速转换？

    谢谢、

    Brian

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    TI__Guru**** 2390755 points
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    您好 Brian、

    一旦速率发生变化、DAC 就必须重新同步。

    2.该器件不执行过零检测。  无论输出状态如何、它都会应用这些步骤。

    3 、数字衰减功能的变化率为每8个 LRCK 周期0.5dB 步长、因此非常平滑。

    谢谢、

    Paul