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[参考译文] PCM1802：BCLK/LRCLK 输入序列

admin
Guru**** 2391415 points
Other Parts Discussed in Thread: PCM1802

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/959103/pcm1802-bclk-lrclk-input-sequence

器件型号：PCM1802

您好！

您能告诉我们什么时候应该输入 BCLK 和 LRCLK？

我的客户说、他们在五年前听说过、BCLK 和 LRCLK 应该在1024个系统时钟和4480/FS 之后输入、如下所示。

但是、数据表中没有此类序列信息、因此我们无法查看此信息是否正确。

他们听到该信息的原因是 PCM1802出现了数据因电源启动时序而变得异常的问题、原因是上电复位时序。

上述序列似乎显示为权变措施。

您能否检查此信息是否正确？

此致、

Kuramochi

  • 0
    TI__Guru**** 2391415 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好 Kuramochi、

    老实说、这不是我们以前听说过的要求、也不是我们可以在 E2E 或我们的内部支持存档中找到参考的要求。  这是5年前发布的一篇文章、表明数据表顺序正确。   https://e2e.ti.com/support/audio/f/6/t/432434

    这些产品的使用时间比我一直支持的时间长、因此客户很可能被告知这一点、或者在过去成功尝试过这一点。 由于我们最近尚未听说过这一点、我们的最佳指导是遵循数据表建议的说明。  大多数系统以成对的形式输出 SCLK、BCLK 和 LRCLK、当启用一个时、所有系统都启用、因此当以这种方式使用时、我们希望器件响应良好。  

    如果客户非常有兴趣确保没有任何不正确或无效的时钟输出、那么如果 BCLK 和 LRCLK 保持低电平直到您的图表中注明的点、DOUT 将不会输出任何可能不需要的数据、这将非常安全。