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[参考译文] TLV320DAC3120：无 MCLK

admin
Guru**** 2513185 points
Other Parts Discussed in Thread: TLV320DAC3120

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/962828/tlv320dac3120-without-mclk

器件型号：TLV320DAC3120

你(们)好

FS = 8kHz、CODE_CLKIN 设置为 MCLK = 2.048MHz、BCLK = 256kHz、NDC = 1、MDC = 2、DOSR_LSB = 128、 它正常工作。
接下来，如果没有 MCLK，我将 CODE_CLKIN 设置为 BCLK = 256kHz，NDC = 1，MDC = 2，DOSR_LSB = 32，但 没有扬声器输出。
原因是什么？

此致、

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    TI__Guru**** 2513185 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好！  

    在第二种情况(CODE_CLKIN = BCLK)中、您是否尝试过 DOSR = 64？ 您选择的参数似乎会导致4kHz 的采样率。

    您能否提供整个寄存器配置、以便更好地解决此问题？

    谢谢你。

    此致、
    Luis Fernando Rodríguez S.

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    TI__Guru**** 2513185 points
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    您好！

    DOSR = 32时确认。

    此致。

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    TI__Guru**** 2513185 points
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    您好！

    感谢您的回答。 这是否意味着 DOSR = 32已解决问题？

    我想我在之前的建议上犯了一个错误、MDC 应该为1才能在 DOSR = 32时达到8K 采样率。

    FS = BCLK /(NDC x MDC x DOSR)= 256KHz / 32 = 8kHz。

    此致、
    Luis Fernando Rodríguez S.

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    TI__Guru**** 2513185 points
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    您好！

    这是我的问题中的一个错误。
    我再说一遍。
    我将 CODE_CLKIN 设置为 BCLK = 256kHz、NDC = 1、MDC = 1、DOSR_LSB = 32、但无扬声器输出。

    此致。

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    TI__Guru**** 2513185 points
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    您好！

    感谢您的澄清。

    您能否提供完整的寄存器配置和电路原理图、以便更好地解决此问题？

    谢谢你。

    此致、
    Luis Fernando Rodríguez S.

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    TI__Guru**** 2513185 points
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    你(们)好

    随附了寄存器设置值列表和原理图。

    此致、
    T.Konno.e2e.ti.com/.../DAC-register.xlsxe2e.ti.com/.../TLV320DAC3120_5F00_SCH.pdf

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    TI__Guru**** 2513185 points
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    你(们)好

    随附了寄存器设置值列表和原理图。
    我将再次向您发送该列表。

    此致、
    T.Konno.e2e.ti.com/.../DAC-register.pdf

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    TI__Guru**** 2513185 points
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    你(们)好

    很抱歉、原理图的注释中出现了错误。
    时钟频率正确、MCLK 未连接
    I2C3_SCK = 256kHz
    I2C3_WS = 8kHz

    此致、
    T.Konno。

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    TI__Guru**** 2513185 points
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    大家好、T.Konno、

    感谢您提供的信息。

    实际上、我注意到页0 /寄存器4配置为0x0D。 这将正确地将 BCLK 作为 CODE_CLKIN、但该值也将 DIN 设置为 PLL 时钟。 因此、您用于 DIN 的所有数据都将被忽略。

    您可以将此值从0x0D 修改为0x01吗？

    如果您仍有问题、请告诉我。

    此致、
    Luis Fernando Rodríguez S.

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    TI__Guru**** 2513185 points
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    你(们)好

    感谢您的验证。

    即使我将其更改为0x01、也没有声音。

    当我尝试将 PLL 与0x0D 搭配使用时、会发出声音。
    但似乎有许多抖动。
    是因为已超出频率限制？ (BCLK = 256kHz。)

    此致、
    T.Konno。    

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    TI__Guru**** 2513185 points
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    大家好、T.Konno、

    感谢您的详细信息。 我一直在寻找一些有关时钟限制的信息、实际上支持的最小输入时钟为512KHz。 因此、时钟生成树不能在 BCLK = 256KHz 作为主时钟时正常工作。

    您需要修改 I2S 时钟设置、以便至少匹配最小时钟值。

    此致、
    Luis Fernando Rodríguez S.

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    TI__Guru**** 2513185 points
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    您好！
    路易斯·费尔南多·罗德里格斯·S.

    感谢您的回答。

    我将 BLCK 设置为512K 并使用 CDIV_CLKIN 选择它、但它不起作用。
    但是、通过将 BLCK 设置为512K 并使用 PLL、我能够正常工作。
    继续使用此设置进行验证。

    非常感谢。
    T. Konno。