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[参考译文] LMK04821:具有低噪声和抖动清除器的 PLL

Guru**** 2943400 points

Other Parts Discussed in Thread: LMK04821

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1641543/lmk04821-pll-with-low-noise-and-jitter-cleaner

器件型号: LMK04821

您好、

我正在为 JESD204B 应用寻找一款具有低噪声和时钟抖动清除器的高性能 PLL。

该器件应支持 2MHz 至 125MHz 的时钟输入范围(将使用多路复用器在源之间进行选择)。

器件应提供 13 个输出:

  • 12 × LVDS 输出高达 125MHz
  • 1 × SYSREF 输出(可配置为静态‘1'或‘0')、能够驱动 9 个从器件

我发现的理想选择是 LMK04821;不过、输出分为 4 组。 我担心在使用单个 SYSREF 同步所有 9 个从器件时出现的时序问题、因为其中一些从器件可能不属于同一个 SYSREF 组。

如有任何其他建议、将不胜感激。 如果需要更多详细信息、请告知我。

谢谢。

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    您好!

    一个 125MHz 时钟周期为 8ns。 因此、系统参考和 125MHz 时钟之间的窗口为 4ns。 LMK04821 的通道间偏差仅为 50ps、该偏差不会对系统造成损害。

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    嗨、Noel、很抱歉耽误你的时间。

    LMK04821 是否 支持 对所有 8 个从器件(扇出 1->9)(电容,驱动能力等)使用一个 SYSREF(单次触发)输出?

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    尊敬的 Yoav:

    差分信号传输通常是点对点的、扇出缓冲器需要生成多个副本。