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[参考译文] CDCLVC1104:CDCLVC1104PW 故障排除

Guru**** 2382480 points
Other Parts Discussed in Thread: CDCLVC1104
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1065907/cdclvc1104-cdclvc1104pw-troubleshoot

部件号:CDCLVC1104

大家好,团队

美好的一天! 我代表客户发布此信息。

我已在下面分享了调查的全部详细信息:

我正在使用 CDCLVC1104PW 缓冲来自 FPGA (Spartan6)的传入时钟(100MHz-200MHz),并将它们应用到四个数模转换器(AD9742ARU)。 TI 数据表中的所有布局建议都试图满足。 但是,CDCLVC1104PW 的输出值相同,大约为60 MV (似乎所有输入时钟的更改都被忽略)。 此外,电源电压和高电平输入 CLK 为3.3V,输入 CLK 正确满足 VHL 和 VLH 的要求。
“时钟缓冲 IC”的所有输出信号都有相同的问题(与输入信号变化相关的输出针脚没有变化)。 此外,我尝试了不同的输入 CLK,频率为10MHz,50MHz,200MHz,甚至我直接对输入引脚(以及 GND)应用了3.3V,但输出引脚始终等于‘0’。
即使将输出引脚与电路的其余部分分开,情况也不会改变。  
如果有任何问题或解决方案可以解决,请告诉我。  
印刷电路板布局,原理图,输入时钟,VCC 和输出的一些图片如以下所示(随附文件):  

e2e.ti.com/.../CDCLVC1104PW-Problem.docx

此致,

乔纳森

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    乔纳森您好,

    感谢详细的问题描述。 我有几个澄清问题:

    1.您是否已确认 CDCLVC1104导联的 VDD 和1G 电压水平?

    2.您是否直接在 CDCLVC1104的针脚1处探测输入时钟?

    3.您能否在 FPGA 和 CDCLVC1104之间共享连接原理图?

    4.能否对来自 FPGA 的时钟进行方形?

    5.这种行为是在单个电路板上发生的吗? 如果是,您是否尝试更换缓冲器?

    此致,

    朱利安  

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    朱利安,你好!

    以下是客户对您问题的回答。 已附加在 Word 文档中。

    e2e.ti.com/.../CDCLVC1104PW-Problem_5F00_V2.docx

    此致,

    乔纳森

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    乔纳森您好,

    如果10个集成电路出现故障,则可能存在系统问题。

    所有10个 IC 是否都有相同的顶部标记? 如果是,请订购几个样本,用不同批次进行检查。

    您能否共享细菌文件或更好分辨率的 PCB 图片(所有图层)?

    愚蠢的问题:IC 的引脚1在 PCB 的引脚1上?

    您是否尝试切换1G 引脚?

    此致,

    朱利安

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     朱利安,你好!

    以下是客户提供的更新。

    印刷电路板的 Gerber 文件已附加。 此外,他们确信 每个引脚的分配名称,原理图 和封装都是正确的。

    e2e.ti.com/.../CAMtastic1.Cam

    此致,

    乔纳森

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    乔纳森您好,

    细菌文件对我来说看起来正常。 我只是看不到“VCC+3.3V”连接到哪里(可能缺少某些层)。 不管怎样,您确认电源电压已存在,因此我认为这是正常的。

    最好尝试使用已知良好的装置(例如使用 EVM 测试)并将其放在 PCB 上。 同时在 EVM 上放置一个“坏”装置。

    如果 EVM 上的坏器件也无法正常工作,我建议将该器件退回进行分析。

    此致,

    朱利安